标签: 浮点ip内核

最近出现的FPGA设计工具和IP有效减少了计算占用的资源，大大简化了浮点数据通路的实现。而且，与数字信号处理器不同，FPGA能够支持浮点和定点混合工作的DSP数据通路，实现的性能超过了100GFLOPS。在所有信号处理算法中，对于只需要动态范围浮点算法的很多高性能DSP应用，这是非常重要的优点。选择FPGA并结合浮点工具和IP，设计人员能够灵活的处理定点数据宽度、浮点数据精度和达到的性能等级，而这是处理器体系结构所无法实现的。白皮书充分发挥FPGA浮点IP内核的优势最近出现的FPGA设计工具和IP有效减少了计算占用的资源，大大简化了浮点数据通路的实现。而且，与数字信号处理器不同，FPGA能够支持浮点和定点混合工作的DSP数据通路，实现的性能超过了100GFLOPS。在所有信号处理算法中，对于只需要动态范围浮点算法的很多高性能DSP应用，这是非常重要的优点。选择FPGA并结合浮点工具和IP，设计人员能够灵活的处理定点数据宽度、浮点数据精度和达到的性能等级，而这是处理器体系结构所无法实现的。引言对于通信、军事、医疗等应用中的很多复杂系统，首先要使用浮点数据处理算法，利用C或者MATLAB软件进行仿真和建模。而最终实现几乎都采用定点或者整数算法。算法被仔细映射到有限动态范围内，调整数据通路中的每一功能。这就需要很多取整和饱和步骤，如果处理的不合适，就会对算法性能有不利的影响。在集成过程中一般还需要进行大量的验证工作，以确保系统工作符合仿真结果。以前，由于缺乏FPGA工具包的支持，FPGA设计人员一般不选择浮点算法。使用很多浮点FPGA运算符时，由于需要大量逻辑和布线资源，因此，它的另一个缺点是性能太差。FPGA高效实现复数浮点函数的关键是使用基于乘法器的算法，利用大量集成在FPGA器件中的硬件乘法器资源。用于实现这些非线性函数的乘法器必须有很高的精度，以保证乘法迭代过程中的精度要求。而且，高精度乘法器不需要在每一次乘法迭……