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基于HEVC的CABAC二进制算术编码器的FPGA实现

提出一种基于H.264的上下文自适应二进制算术编码器硬件设计方法.本设计中包含一个由二进制化以及上下文模型组成的14组并行上下文对产生器,一个抓取邻近区块数据的三级流水线结构以及一个内含前馈处理且融合三种模式的四级流水线结构的算术编码器.该算术编码器可以一个时钟处理一个位元;整个设计平均每个时钟处理0.77个位元.集成电路应用一种新型Ｈ．２６４ＣＡＢＡＣ编码器硬件结构设计何俊。王阳明（西南科技大学信息工程学院，四川６２１０００）摘要：提出一种基于Ｈ．２“的上下文自适应二进制算术编码器硬件设计方法。本设计中包含一个由二进制化以及上下文模型组成的１４组并行上下文对产生器。一个抓取邻近区块数据的三级流水线结构以厦一个内含前馈处理且融合三种模式的四级流水线结构的算术编码器。该算术编码器可以一个时钟处理一个位元；整个设计平均每个时钟处理Ｏ．７７个位元。关键词：上下文自适应ＣＡＢＡＣＨ．２６４，ＡＶＣ语法元素Ａｈａｒｄｗａｒｅｃｏｎｔｅｘｔ―ｂａｓｅｄａｄａｐｔｉＶｅｂｉｎａＩｙａｒｉｔｈｍｅｔｉｃｅｎｃｏｄｅｒｂａｓｅｄｏｎＨ．２６４ａｄＶａｎｃｅｄＶｉｄｅｏｃｏｄ……

H.264是由国际电信联盟(ITU)和国际标准化组织(ISO)共同制定的新一代视频编码标准，该标准采用一系列先进的编码技术，在编码效率、网络适应性等诸多方面都超越了以往的视频标准。……

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