原创 本人收集的PCB经验

太有用了！

好

太经典了

大侠，我要做一个电路板，元件比较多，需要在一个DIP16封装的元件的背面焊几个贴片电容。但是放上去之后显示绿色（说明有错误），怎么才能不显示这个错误呢？ 我觉得应该是在 Design--->Rules 里面进行修改某个参数吧。请赐教一下。 谢谢！

第三篇 布局布线技术的发展 摘要：随着微孔和单片高密度集成系统等新硬件技术的应用，自由角度布线、自动布局和3D布局布线等新型软件将会成为电路板设计人员必备的设计工具之一。 在早期的电路板设计工具中，布局有专门的布局软件，布线也有专门的布线软件，两者之间没什么联系。随着球栅阵列封装的高密度单芯片、高密度连接器、微孔内建技术以及3D板在印刷电路板设计中的应用，布局和布线已越来越一体化，并成为设计过程的重要组成部分。 自动布局和自由角度布线等软件技术已渐渐成为解决这类高度一体化问题的重要方法，利用此类软件能在规定时间范围内设计出可制造的电路板。在目前产品上市时间越来越短的情况下，手动布线极为耗时，不合时宜。因此，现在要求布局布线工具具有自动布线功能，以快速响应市场对产品设计提出的要求。 1、设计约束条件 由于要考虑电磁兼容(EMC)及电磁干扰、串扰、信号延迟和差分对布线等高密度设计因素，布局布线的约束条件每年都在增加。例如，在几年前，一般的电路板仅需6个差分对来进行布线，而现在则需600对。在一定时间内仅依赖手动布线来实现这600对布线是不可能的，因此自动布线工具必不可少。 尽管与几年前相比，当今设计中的节点(net)数目没有大的改变，只是硅片复杂性有所增加，但是设计中重要节点的比例大大增加了。当然，对于某些特别重要的节点，要求布局布线工具能够加以区分，但无需对每个管脚或节点都加以限制。 2、自由角度布线 随着单片器件上集成的功能越来越多，其输出管脚数目也大大增加，但其封装尺寸并没随之扩大。因此，再加上管脚间距和阻抗因素的限制，这类器件必须采用更细的线宽。同时产品尺寸的总体减小也意味着用于布局布线的空间也大大减小了。在某些消费类产品中，底板的大小与其上器件大小相差无几，元件占据的板面积高达80%。 某些高密度元件管脚交错，即使采用具45°布线功能的工具也无法进行自动布线。尽管45°布线工具能对某些恰成45°的线段进行完美的处理，但自由角度布线工具具有更大的灵活性，并能最大程度提高布线密度。 拉紧(pull-tight)功能使每个节点在布线后自动缩短以适应空间要求，它能大大降低信号延迟，同时降低平行路径数，有助于避免串扰的产生。 尽管自由角度设计具有可制造性，并且性能良好，但是这种设计会导致主板看起来不如以前的设计美观。主板设计在上市时间之后，就可能不再是一件艺术品了。 3、高密度器件 最新的高密度系统级芯片采用BGA或COB封装，管脚间距日益减小。球间距已低至1mm，并且还会继续降低，导致封装件信号线不可能采用传统布线工具来引出。目前有两种方法可解决这个问题：一是通过球下面的孔将信号线从下层引出；二是采用极细布线和自由角度布线在球栅阵列中找出一条引线通道。对这种高密度器件而言，采用宽度和空间极小的布线方式是唯一可行的，只有这样，才能保证较高的成品率。现代的布线技术也要求能自动地应用这些约束条件。 自由布线方法可减少布线层数，降低产品成本。同时也意味着在成本不变的情况下，可以增加一些接地层和电源层来提高信号完整性和EMC性能。 4、下一代电路板设计技术 微孔等离子蚀刻技术在多层板，尤其是在蜂窝电话和家用电器中的应用大大改变了对布局布线工具的要求。采用等离子蚀刻法在路径宽度内添加一个新孔不会导致底板本身或制造成本的增加，因为对等离子蚀刻法而言，制作一千个孔的成本与制作一个孔的成本一样低廉(这与激光钻孔法大不一样)。这就要求布线工具具有更大的灵活性，它必须能够应用不同的约束条件，能适应不同的微孔和构建技术的要求。 元件密度的不断增加也对布局设计产生了某些影响。布局布线工具总是假设板上有足够的空间让元件拾放机来拾放表面安装元件，而不会对板上已有元件产生影响。但是元件顺序放置会产生这样一个问题，即每当放置一个新元件后，板上每个元件的最佳位置都会发生改变。 这就是布局设计过程自动化程度低而人工干预程度高的原因。尽管目前的布局工具对依次布局的元件数没什么限制，但是某些工程师认为布局工具用于依次布局时实际上是受到限制的，这个限制大约为500个元件。还有一些工程师认为当在一个板上放置的元件多达4,000个时，会产生很大问题。 同顺序算法技术相比，并行布局技术能实现更好的自动布局效果。因此，当Zuken收购Incases公司后，Incases的并行布局技术使Zuken获益非浅。 5、三维布局 3D工具针对目前应用日益广泛的异形和定形板进行布局布线。如 Zuken的Freedom最新工具采用三维底板模型来进行元件的空间布局，随后再进行二维布线。此过程也能告知：此板是否具备可制造性？ 将来，诸如在两个不同层上采用阴影差分对的设计方法将会变得日益重要，布线工具也必须能处理这种设计，而且信号速率也将会继续提高。 目前也出现了将布局布线工具同用于虚拟原型的高级仿真工具集成起来的工具，如Zuken的Hot Stage工具，所以即使在虚拟原型时也能对布线问题进行考虑。 现在，自动布线技术已极为普及。我们相信，自由角度布线、自动布局和3D布局等新型软件技术也会同自动布线技术一样成为底板设计人员的日常设计工具，设计人员可用这些新工具来解决微孔和单片高密度集成系统等新型硬件技术问题。

最明显，因为这种方式的终端匹配将入射波(在传输线上传播的原始波形)降低到了Vcc的一半，因而减小了驱动传输线所需的瞬时吸纳电流。这种技术通过减少“Ldi/dt”中的“di”项来达到降低EMI的目的。 某些IC厂商将终端匹配电阻放在IC封装内部，这样除了能够降低EMI和提高信号完整性，还减少了PCB板上的电阻数目。检查IC芯片是否采用了这样的技术可以更加清楚IC的输出阻抗。当IC的输出阻抗同传输线的阻抗匹配时，就可以认为这样的传输线实现了“串联终端匹配”。值得注意的是串联终端匹配的IC采用了信号转换的反射模型。而在实际应用中如果沿传输线方向分布有多个负载，并且有非常严格的时序要求，这时串联终端匹配就可能不起作用。 最后，某些IC芯片输出信号的斜率也受到控制。对大多数的TTL和CMOS器件来说，当它们的输出级信号发生切换时，输出晶体管完全导通，这样就会产生很大的瞬间电流来驱动传输线。电源总线上如此大的浪涌电流势必产生非常大的电压瞬变(V=Ldi/dt)。而许多ECL、MECL和PECL器件通过在输出晶体管线性区的高低电平之间的转换来驱动输出级，通常称之为非饱和逻辑，其结果是输出波形的波峰和波谷会被削平，因而减小了高频谐波分量的幅度。这种技术通过提升表达式“Ldi/dt”中的信号上升时间“dt”项来减小EMI。 总结 通过仔细考察集成电路芯片的封装、引线结构类型、输出驱动器的设计方法以及去耦电容的设计方法，可以得出有益的设计规则，在电路设计中要注意选择和使用符合以下特征的电子元器件： *外形尺寸非常小的SMT或者BGA封装； *芯片内部的PCB是具有电源层和接地层的多层PCB设计； *IC硅基芯片直接粘接在内部的小PCB上(没有绑定线)； *电源和地成对并列相邻出现(避免电源和地出现在芯片的边角位置，如74系列逻辑电路)； *多个电源和地管脚成对配置； *信号返回管脚(比如地脚)与信号管脚之间均匀分布； *类似于时钟这样的关键信号配置专门的信号返回管脚； *采用可能的最低驱动电压(Vcc)，如相对于5V来说可以采用3.3V的驱动电压，或者使用低电压差分逻辑(LVDS)； *在IC封装内部使用了高频去耦电容； *在硅基芯片上或者是IC封转内部对输入和输出信号实施终端匹配； *输出信号的斜率受控制。 总之，选择IC器件的一个最基本的规则是只要能够满足设计系统的时序要求就应该选择具有最长上升时间的元器件。一旦设计工程师做出最终的决定，但是仍然不能确定同一工艺技术不同厂商生产的器件电磁干扰的情况，可以选择不同厂商生产的器件做一些测试。将有疑问的IC芯片安装到一个专门设计的测试电路板上，启动时钟运行和高速数据操作。通过连接到频谱分析仪或宽带示波器上的近场磁环路探针可以容易地测试电路板的电磁发射。 第二篇 实现PCB高效自动布线的设计技巧和要点 尽管现在的EDA工具很强大，但随着PCB尺寸要求越来越小，器件密度越来越高，PCB设计的难度并不小。如何实现PCB高的布通率以及缩短设计时间呢？本文介绍PCB规划、布局和布线的设计技巧和要点。 现在PCB设计的时间越来越短，越来越小的电路板空间，越来越高的器件密度，极其苛刻的布局规则和大尺寸的元件使得设计师的工作更加困难。为了解决设计上的困难，加快产品的上市，现在很多厂家倾向于采用专用EDA工具来实现PCB的设计。但专用的EDA工具并不能产生理想的结果，也不能达到100%的布通率，而且很乱，通常还需花很多时间完成余下的工作。 现在市面上流行的EDA工具软件很多，但除了使用的术语和功能键的位置不一样外都大同小异，如何用这些工具更好地实现PCB的设计呢？在开始布线之前对设计进行认真的分析以及对工具软件进行认真的设置将使设计更加符合要求。下面是一般的设计过程和步骤。 1、确定PCB的层数 电路板尺寸和布线层数需要在设计初期确定。如果设计要求使用高密度球栅阵列(BGA)组件，就必须考虑这些器件布线所需要的最少布线层数。布线层的数量以及层叠(stack-up)方式会直接影响到印制线的布线和阻抗。板的大小有助于确定层叠方式和印制线宽度，实现期望的设计效果。 多年来，人们总是认为电路板层数越少成本就越低，但是影响电路板的制造成本还有许多其他因素。近几年来，多层板之间的成本差别已经大大减小。在开始设计时最好采用较多的电路层并使敷铜均匀分布，以避免在设计临近结束时才发现有少量信号不符合已定义的规则以及空间要求，从而被迫添加新层。在设计之前认真的规划将减少布线中很多的麻烦。 2、设计规则和限制 自动布线工具本身并不知道应该做些什么。为完成布线任务，布线工具需要在正确的规则和限制条件下工作。不同的信号线有不同的布线要求，要对所有特殊要求的信号线进行分类，不同的设计分类也不一样。每个信号类都应该有优先级，优先级越高，规则也越严格。规则涉及印制线宽度、过孔的最大数量、平行度、信号线之间的相互影响以及层的限制，这些规则对布线工具的性能有很大影响。认真考虑设计要求是成功布线的重要一步。 3、元件的布局 为最优化装配过程，可制造性设计(DFM)规则会对元件布局产生限制。如果装配部门允许元件移动，可以对电路适当优化，更便于自动布线。所定义的规则和约束条件会影响布局设计。 在布局时需考虑布线路径(routing channel)和过孔区域，如图 所示。这些路径和区域对设计人员而言是显而易见的，但自动布线工具一次只会考虑一个信号，通过设置布线约束条件以及设定可布信号线的层，可以使布线工具能像设计师所设想的那样完成布线。 4、扇出设计 在扇出设计阶段，要使自动布线工具能对元件引脚进行连接，表面贴装器件的每一个引脚至少应有一个过孔，以便在需要更多的连接时，电路板能够进行内层连接、在线测试(ICT)和电路再处理。 为了使自动布线工具效率最高，一定要尽可能使用最大的过孔尺寸和印制线，间隔设置为50mil较为理想。要采用使布线路径数最大的过孔类型。进行扇出设计时，要考虑到电路在线测试问题。测试夹具可能很昂贵，而且通常是在即将投入全面生产时才会订购，如果这时候才考虑添加节点以实现100%可测试性就太晚了。 经过慎重考虑和预测，电路在线测试的设计可在设计初期进行，在生产过程后期实现，根据布线路径和电路在线测试来确定过孔扇出类型，电源和接地也会影响到布线和扇出设计。为降低滤波电容器连接线产生的感抗，过孔应尽可能靠近表面贴装器件的引脚，必要时可采用手动布线，这可能会对原来设想的布线路径产生影响，甚至可能会导致你重新考虑使用哪种过孔，因此必须考虑过孔和引脚感抗间的关系并设定过孔规格的优先级。 5、手动布线以及关键信号的处理 尽管本文主要论述自动布线问题，但手动布线在现在和将来都是印刷电路板设计的一个重要过程。采用手动布线有助于自动布线工具完成布线工作。如图2a和图2b所示，通过对挑选出的网络(net)进行手动布线并加以固定，可以形成自动布线时可依据的路径。 无论关键信号的数量有多少，首先对这些信号进行布线，手动布线或结合自动布线工具均可。关键信号通常必须通过精心的电路设计才能达到期望的性能。布线完成后，再由有关的工程人员来对这些信号布线进行检查，这个过程相对容易得多。检查通过后，将这些线固定，然后开始对其余信号进行自动布线。 6、自动布线 对关键信号的布线需要考虑在布线时控制一些电参数，比如减小分布电感和EMC等，对于其它信号的布线也类似。所有的EDA厂商都会提供一种方法来控制这些参数。在了解自动布线工具有哪些输入参数以及输入参数对布线的影响后，自动布线的质量在一定程度上可以得到保证。 应该采用通用规则来对信号进行自动布线。通过设置限制条件和禁止布线区来限定给定信号所使用的层以及所用到的过孔数量，布线工具就能按照工程师的设计思想来自动布线。如果对自动布线工具所用的层和所布过孔的数量不加限制，自动布线时将会使用到每一层，而且将会产生很多过孔。 在设置好约束条件和应用所创建的规则后，自动布线将会达到与预期相近的结果，当然可能还需要进行一些整理工作，同时还需要确保其它信号和网络布线的空间。在一部分设计完成以后，将其固定下来，以防止受到后边布线过程的影响。 采用相同的步骤对其余信号进行布线。布线次数取决于电路的复杂性和你所定义的通用规则的多少。每完成一类信号后，其余网络布线的约束条件就会减少。但随之而来的是很多信号布线需要手动干预。现在的自动布线工具功能非常强大，通常可完成100%的布线。但是当自动布线工具未完成全部信号布线时，就需对余下的信号进行手动布线。 7、自动布线的设计要点包括： 7.1 略微改变设置，试用多种路径布线； 7.2 保持基本规则不变，试用不同的布线层、不同的印制线和间隔宽度以及不同线宽、不同类型的过孔如盲孔、埋孔等，观察这些因素对设计结果有何影响； 7.3让布线工具对那些默认的网络根据需要进行处理； 7.4信号越不重要，自动布线工具对其布线的自由度就越大。 8、布线的整理 如果你所使用的EDA工具软件能够列出信号的布线长度，检查这些数据，你可能会发现一些约束条件很少的信号布线的长度很长。这个问题比较容易处理，通过手动编辑可以缩短信号布线长度和减少过孔数量。在整理过程中，你需要判断出哪些布线合理，哪些布线不合理。同手动布线设计一样，自动布线设计也能在检查过程中进行整理和编辑。 9、电路板的外观 以前的设计常常注意电路板的视觉效果，现在不一样了。自动设计的电路板不比手动设计的美观，但在电子特性上能满足规定的要求，而且设计的完整性能得到保证

第一篇 掌握IC封装的特性以达到最佳EMI抑制性能 将去耦电容直接放在IC封装内可以有效控制EMI并提高信号的完整性，本文从IC内部封装入手，分析EMI的来源、IC封装在EMI控制中的作用，进而提出11个有效控制EMI的设计规则，包括封装选择、引脚结构考虑、输出驱动器以及去耦电容的设计方法等，有助于设计工程师在新的设计中选择最合适的集成电路芯片，以达到最佳EMI抑制的性能。 现有的系统级EMI控制技术包括： （1） 电路封闭在一个Faraday盒中(注意包含电路的机械封装应该密封)来实现EMI屏蔽； （2） 电路板或者系统的I/O端口上采取滤波和衰减技术来实现EMI控制； （3） 现电路的电场和磁场的严格屏蔽，或者在电路板上采取适当的设计技术严格控制PCB走线和电路板层(自屏蔽)的电容和电感，从而改善EMI性能。 EMI控制通常需要结合运用上述的各项技术。一般来说，越接近EMI源，实现EMI控制所需的成本就越小。PCB上的集成电路芯片是EMI最主要的能量来源，因此如果能够深入了解集成电路芯片的内部特征，可以简化PCB和系统级设计中的EMI控制。 PCB板级和系统级的设计工程师通常认为，它们能够接触到的EMI来源就是PCB。显然，在PCB设计层面，确实可以做很多的工作来改善EMI。然而在考虑EMI控制时，设计工程师首先应该考虑IC芯片的选择。集成电路的某些特征如封装类型、偏置电压和芯片的工艺技术(例如CMOS、ECL、TTL)等都对电磁干扰有很大的影响。本文将着重讨论这些问题，并且探讨IC对EMI控制的影响。 1、EMI的来源 数字集成电路从逻辑高到逻辑低之间转换或者从逻辑低到逻辑高之间转换过程中，输出端产生的方波信号频率并不是导致EMI的唯一频率成分。该方波中包含频率范围宽广的正弦谐波分量，这些正弦谐波分量构成工程师所关心的EMI频率成分。最高EMI频率也称为EMI发射带宽，它是信号上升时间而不是信号频率的函数。计算EMI发射带宽的公式为： F=0.35/Tr 其中：F是频率，单位是GHz；Tr是单位为ns(纳秒)的信号上升时间或者下降时间。 从上述公式中不难看出，如果电路的开关频率为50MHz，而采用的集成电路芯片的上升时间是1ns，那么该电路的最高EMI发射频率将达到350MHz，远远大于该电路的开关频率。而如果IC的上升时间为500ps，那么该电路的最高EMI发射频率将高达700MHz。众所周知，电路中的每一个电压值都对应一定的电流，同样每一个电流都存在对应的电压。当IC的输出在逻辑高到逻辑低或者逻辑低到逻辑高之间变换时，这些信号电压和信号电流就会产生电场和磁场，而这些电场和磁场的最高频率就是发射带宽。电场和磁场的强度以及对外辐射的百分比，不仅是信号上升时间的函数，同时也取决于对信号源到负载点之间信号通道上电容和电感的控制的好坏，在此，信号源位于PCB板的IC内部，而负载位于其它的IC内部，这些IC可能在PCB上，也可能不在该PCB上。为了有效地控制EMI，不仅需要关注IC芯片自身的电容和电感，同样需要重视PCB上存在的电容和电感。 当信号电压与信号回路之间的耦合不紧密时，电路的电容就会减小，因而对电场的抑制作用就会减弱，从而使EMI增大；电路中的电流也存在同样的情况，如果电流同返回路径之间耦合不佳，势必加大回路上的电感，从而增强了磁场，最终导致EMI增加。换句话说，对电场控制不佳通常也会导致磁场抑制不佳。用来控制电路板中电磁场的措施与用来抑制IC封装中电磁场的措施大体相似。正如同PCB设计的情况，IC封装设计将极大地影响EMI。 电路中相当一部分电磁辐射是由电源总线中的电压瞬变造成的。当IC的输出级发生跳变并驱动相连的PCB线为逻辑“高”时，IC芯片将从电源中吸纳电流，提供输出级所需的能量。对于IC不断转换所产生的超高频电流而言，电源总线始于PCB上的去耦网络，止于IC的输出级。如果输出级的信号上升时间为1.0ns，那么IC要在1.0ns这么短的时间内从电源上吸纳足够的电流来驱动PCB上的传输线。电源总线上电压的瞬变取决于电源总线路径上的电感、吸纳的电流以及电流的传输时间。电压的瞬变由下面的公式所定义： V=Ldi/dt， 其中：L是电流传输路径上电感的值；di表示信号上升时间间隔内电流的变化；dt表示电流的传输时间(信号的上升时间)。 由于IC管脚以及内部电路都是电源总线的一部分，而且吸纳电流和输出信号的上升时间也在一定程度上取决于IC的工艺技术，因此选择合适的IC就可以在很大程度上控制上述公式中提到的所有三个要素。 2、IC封装在电磁干扰控制中的作用 IC封装通常包括：硅基芯片、一个小型的内部PCB以及焊盘。硅基芯片安装在小型的PCB上，通过绑定线实现硅基芯片与焊盘之间的连接，在某些封装中也可以实现直接连接。小型PCB实现硅基芯片上的信号和电源与IC封装上的对应管脚之间的连接，这样就实现了硅基芯片上信号和电源节点的对外延伸。贯穿该IC的电源和信号的传输路径包括：硅基芯片、与小型PCB之间的连线、PCB走线以及IC封装的输入和输出管脚。对电容和电感(对应于电场和磁场)控制的好坏在很大程度上取决于整个传输路径设计的好坏。某些设计特征将直接影响整个IC芯片封装的电容和电感。 首先看硅基芯片与内部小电路板之间的连接方式。许多的IC芯片都采用绑定线来实现硅基芯片与内部小电路板之间的连接，这是一种在硅基芯片与内部小电路板之间的极细的飞线。这种技术之所以应用广泛是因为硅基芯片和内部小电路板的热胀系数(CTE)相近。芯片本身是一种硅基器件，其热胀系数与典型的PCB材料(如环氧树脂)的热胀系数有很大的差别。如果硅基芯片的电气连接点直接安装在内部小PCB上的话，那么在一段相对较短的时间之后，IC封装内部温度的变化导致热胀冷缩，这种方式的连接就会因为断裂而失效。绑定线是一种适应这种特殊环境的引线方式，它可以承受大量的弯曲变形而不容易断裂。 采用绑定线的问题在于，每一个信号或者电源线的电流环路面积的增加将导致电感值升高。获得较低电感值的优良设计就是实现硅基芯片与内部PCB之间的直接连接，也就是说硅基芯片的连接点直接粘接在PCB的焊盘上。这就要求选择使用一种特殊的PCB板基材料，这种材料应该具有极低的CTE。而选择这种材料将导致IC芯片整体成本的增加，因而采用这种工艺技术的芯片并不常见，但是只要这种将硅基芯片与载体PCB直接连接的IC存在并且在设计方案中可行，那么采用这样的IC器件就是较好的选择。 一般来说，在IC封装设计中，降低电感并且增大信号与对应回路之间或者电源与地之间电容是选择集成电路芯片过程的首选考虑。举例来说，小间距的表面贴装与大间距的表面贴装工艺相比，应该优先考虑选择采用小间距的表面贴装工艺封装的IC芯片，而这两种类型的表面贴装工艺封装的IC芯片都优于过孔引线类型的封装。BGA封装的IC芯片同任何常用的封装类型相比具有最低的引线电感。从电容和电感控制的角度来看，小型的封装和更细的间距通常总是代表性能的提高。 引线结构设计的一个重要特征是管脚的分配。由于电感和电容值的大小都取决于信号或者是电源与返回路径之间的接近程度，因此要考虑足够多的返回路径。 电源和地管脚应该成对分配，每一个电源管脚都应该有对应的地管脚相邻分布，而且在这种引线结构中应该分配多个电源和地管脚对。这两方面的特征都将极大地降低电源和地之间的环路电感，有助于减少电源总线上的电压瞬变，从而降低EMI。由于习惯上的原因，现在市场上的许多IC芯片并没有完全遵循上述设计规则，然而IC设计和生产厂商都深刻理解这种设计方法的优点，因而在新的IC芯片设计和发布时IC厂商更关注电源的连接。 理想情况下，要为每一个信号管脚都分配一个相邻的信号返回管脚(如地管脚)。实际情况并非如此，即使思想最前卫的IC厂商也没有如此分配IC芯片的管脚，而是采用其它折衷方法。在BGA封装中，一种行之有效的设计方法是在每组八个信号管脚的中心设置一个信号的返回管脚，在这种管脚排列方式下，每一个信号与信号返回路径之间仅相差一个管脚的距离。而对于四方扁平封装(QFP)或者其它鸥翼(gull wing)型封装形式的IC来说，在信号组的中心放置一个信号的返回路径是不现实的，即便这样也必须保证每隔4到6个管脚就放置一个信号返回管脚。需要注意的是，不同的IC工艺技术可能采用不同的信号返回电压。有的IC使用地管脚(如TTL器件)作为信号的返回路径，而有的IC则使用电源管脚(如绝大多数的ECL器件)作为信号的返回路径，也有的IC同时使用电源和地管脚(比如大多数的CMOS器件)作为信号的返回路径。因此设计工程师必须熟悉设计中使用的IC芯片逻辑系列，了解它们的相关工作情况。 IC芯片中电源和地管脚的合理分布不仅能够降低EMI，而且可以极大地改善地弹反射(ground bounce)效果。当驱动传输线的器件试图将传输线下拉到逻辑低时，地弹反射却仍然维持该传输线在逻辑低阈值电平之上，地弹反射可能导致电路的失效或者故障。 IC封装中另一个需要关注的重要问题是芯片内部的PCB设计，内部PCB通常也是IC封装中最大的组成部分，在内部PCB设计时如果能够实现电容和电感的严格控制，将极大地改善设计系统的整体EMI性能。如果这是一个两层的PCB板，至少要求PCB板的一面为连续的地平面层，PCB板的另一层是电源和信号的布线层。更理想的情况是四层的PCB板，中间的两层分别是电源和地平面层，外面的两层作为信号的布线层。由于IC封装内部的PCB通常都非常薄，四层板结构的设计将引出两个高电容、低电感的布线层，它特别适合于电源分配以及需要严格控制的进出该封装的输入输出信号。低阻抗的平面层可以极大地降低电源总线上的电压瞬变，从而极大地改善EMI性能。这种受控的信号线不仅有利于降低EMI，同样对于确保进出IC的信号的完整性也起到重要的作用。 3、其它相关的IC工艺技术问题 集成电路芯片偏置和驱动的电源电压Vcc是选择IC时要注意的重要问题。从IC电源管脚吸纳的电流主要取决于该电压值以及该IC芯片输出级驱动的传输线(PCB线和地返回路径)阻抗。5V电源电压的IC芯片驱动50Ω传输线时，吸纳的电流为100mA；3.3V电源电压的IC芯片驱动同样的50Ω传输线时，吸纳电流将减小到66mA；1.8V电源电压的IC芯片驱动同样的50Ω传输线时，吸纳电流将减小到36mA。由此可见，在公式V=Ldi/dt中，驱动电流从100mA减少到36mA可以有效地降低电压的瞬变V，因而也就降低了EMI。低压差分信号器件(LVDS)的信号电压摆幅仅有几百毫伏，可以想象这样的器件技术对EMI的改善将非常明显。 电源系统的去耦也是一个值得特别关注的问题。IC输出级通过IC的电源管脚吸纳的电流都是由电路板上的去耦网络提供的。降低电源总线上电压下降的一种可行的办法是缩短去耦电容到IC输出级之间的分布路径。这样将降低“Ldi/dt”表达式中的“L”项。由于IC器件的上升时间越来越快，在设计PCB板时唯一可以实施的办法是尽可能地缩短去耦电容到IC输出级之间的分布路径。一种最直接的解决方法是将所有的电源去耦都放在IC内部。最理想的情况是直接放在硅基芯片上，并紧邻被驱动的输出级。对于IC厂商来说，这不仅昂贵而且很难实现。然而如果将去耦电容直接放在IC封装内的PCB板上，并且直接连接到硅基芯片的管脚，这样的设计成本增加得最少，对EMI控制和提高信号完整性的贡献最大。目前仅有少数高端微处理器采用了这种技术，但是IC厂商们对这项技术的兴趣正与日俱增，可以预见这样的设计技术必将在未来大规模、高功耗的IC设计中普遍应用。 在IC封装内部设计的电容通常数值都很小(小于几百皮法)，所以系统设计工程师仍然需要在PCB板上安装数值在0.001uF到0.1uF之间的去耦电容，然而IC封装内部的小电容可以抑制输出波形中的高频成分，这些高频成分是EMI的最主要来源。 传输线终端匹配也是影响EMI的重要问题。通过实现网络线的终端匹配可以降低或者消除信号反射。信号反射也是影响信号完整性的一个重要因素。从减小EMI的角度来看，串行终端匹配效果

1:布板时先把布线区缩小，按住右键，看看画板能不能上下左右移动， 如果不能，就向不能移动的反方向移直到合适位置，在定原点，这样 做，便于你画板时能保证移动自如。 2:把tools/preferences/display--Transparent Layer选中(透明显示) 这样元件层和布线层都是半透明的，这样可以看清元件下的布线情况 3:尽量把tools/preferences/Options--Other--Cursor Type选为Large 90 这样可以直观的把光标当十字尺用. 4:大面积铺地时尽量铺成网格地，这样可以防止连地点焊接不良和变型 5:有时候要对板子局部修改，又没有网络表的情况下，可以通过PCB图反向 生成网络表，生成后再调进PCB，再自动布线，成功率几乎100%. 6:有个特殊粘贴命令可以避免复制出来的板图多出一个后缀,一般人不去用的. 7:如果怕你的板子做好后定位不准，可以用打印机打出来再粘到硬纸板上， 再用剪刀剪下来和安装件比对比对，此法虽然笨，但管用.

Protel元件件封装全攻略 零件封装是指实际零件焊接到电路板时所指示的外观和焊点的位置。是纯粹的空间概念.因此不同的元件可共用同一零件封装，同种元件也可有不同的零件封装。像电阻，有传统的针插式，这种元件体积较大，电路板必须钻孔才能安置元件，完成钻孔后，插入元件，再过锡炉或喷锡（也可手焊），成本较高，较新的设计都是采用体积小的表面贴片式元件（SMD）这种元件不必钻孔，用钢膜将半熔状锡膏倒入电路板，再把SMD元件放上，即可焊接在电路板上了。 电阻 AXIAL 无极性电容 RAD 电解电容 RB- 电位器 VR 二极管 DIODE 三极管 TO 电源稳压块78和79系列 TO－126H和TO-126V 场效应管 和三极管一样 整流桥 D－44 D－37 D－46 单排多针插座 CON SIP 双列直插元件 DIP 晶振 XTAL1 电阻： 封装属性为AXIAL系列 无极性电容：封装属性为RAD-0.1到RAD-0.4 电解电容： 封装属性为RB.2/.4到RB.5/1.0 电位器：封装属性为VR -1到VR -5 二极管：封装属性为DIODE-0.4(小功率)DIODE-0.7(大功率) 三极管：常见的封装属性为TO-18（普通三极管）TO-22(大功率三极管)TO-3(大功率达林顿管) 电源稳压块有78和79系列；78系列如7805，7812，7820等 ,79系列有7905，7912，7920等 ,常见的封装属性有TO126H和TO126V 整流桥：封装属性为D系列（D-44，D-37，D-46） 电阻：　AXIAL0.3-AXIAL0.7　　其中0.4-0.7指电阻的长度，一般用AXIAL0.4 瓷片电容：RAD0.1-RAD0.3 　　其中0.1-0.3指电容大小，一般用RAD0.1 电解电容：RB.1/.2-RB.4/.8 其中.1/.2-.4/.8指电容大小。一般小于100uF用 RB.1/.2,100uF-470uF用RB.2/.4, 大于470uF用RB.3/.6 二极管：　DIODE0.4-DIODE0.7 其中0.4-0.7指二极管长短，一般用DIODE0.4 发光二极管：RB.1/.2 集成块：　DIP8-DIP40, 其中８－４０指有多少脚，８脚的就是DIP8 贴片电阻 0603表示的是封装尺寸 与具体阻值没有关系 但封装尺寸与功率有关 通常来说 0201 1/20W 0402 1/16W 0603 1/10W 0805 1/8W 1206 1/4W 电容电阻外形尺寸与封装的对应关系是: 0402=1.0x0.5 0603=1.6x0.8 0805=2.0x1.2 1206=3.2x1.6 1210=3.2x2.5 1812=4.5x3.2 2225=5.6x6.5 关于零件封装我们在前面说过，除了DEVICE.LIB库中的元件外，其它库的元件都已经有了固定的元件封装，这是因为这个库中的元件都有多种形式：以晶体管为例说明一下： 晶体管是我们常用的的元件之一，在DEVICE.LIB库中，简简单单的只有NPN与PNP之分，但实际上，如果它是NPN的2N3055那它有可能是铁壳子的TO—3，如果它是NPN的2N3054，则有可能是铁壳的TO-66或TO-5，而学用的CS9013，有TO-92A，TO-92B，还有TO-5，TO-46，TO-52等等，千变万化。 还有一个就是电阻，在DEVICE库中，它也是简单地把它们称为RES1和RES2，不管它是100Ω 还是470KΩ都一样，对电路板而言，它与欧姆数根本不相关，完全是按该电阻的功率数来决定的我们选用的1/4W和甚至1/2W的电阻，都可以用AXIAL0.3元件封装，而功率数大一点的话，可用AXIAL0.4,AXIAL0.5等等。现将常用的元件封装整理如下： 电阻类及无极性双端元件 AXIAL0.3-AXIAL1.0 无极性电容 RAD0.1-RAD0.4 有极性电容 RB.2/.4-RB.5/1.0 二极管 DIODE0.4及 DIODE0.7 石英晶体振荡器 XTAL1 晶体管、FET、UJT TO-xxx(TO-3,TO-5) 可变电阻（POT1、POT2） VR1-VR5 这些常用的元件封装，大家最好能把它背下来，这些元件封装，大家可以把它拆分成两部分来记如电阻AXIAL0.3可拆成AXIAL和0.3，AXIAL翻译成中文就是轴状的，0.3则是该电阻在印刷电路板上的焊盘间的距离也就是300mil（因为在电机领域里，是以英制单位为主的。同样的，对于无极性的电容，RAD0.1-RAD0.4也是一样；对有极性的电容如电解电容，其封装为RB.2/.4，RB.3/.6等，其中“.2”为焊盘间距，“.4”为电容圆筒的外径。 对于晶体管，那就直接看它的外形及功率，大功率的晶体管，就用TO—3，中功率的晶体管，如果是扁平的，就用TO-220，如果是金属壳的，就用TO-66，小功率的晶体管，就用TO-5，TO-46，TO-92A等都可以，反正它的管脚也长，弯一下也可以。对于常用的集成IC电路，有DIPxx，就是双列直插的元件封装，DIP8就是双排，每排有4个引脚，两排间距离是300mil,焊盘间的距离是100mil。SIPxx就是单排的封装。等等。 值得我们注意的是晶体管与可变电阻，它们的包装才是最令人头痛的，同样的包装，其管脚可不一定一样。例如，对于TO-92B之类的包装，通常是1脚为E（发射极），而2脚有可能是B极（基极），也可能是C（集电极）；同样的，3脚有可能是C，也有可能是B，具体是那个，只有拿到了元件才能确定。因此，电路软件不敢硬性定义焊盘名称（管脚名称），同样的，场效应管，MOS管也可以用跟晶体管一样的封装，它可以通用于三个引脚的元件。 Q1-B，在PCB里，加载这种网络表的时候，就会找不到节点（对不上）。 在可变电阻上也会出现类似的问题；在原理图中，可变电阻的管脚分别为1、W、及2，所产生的网络表，就是1、2和W，在PCB电路板中，焊盘就是1，2，3。当电路中有这两种元件时，就要修改PCB与SCH之间的差异最快的方法是在产生网络表后，直接在网络表中，将晶体管管脚改为1，2，3；将可变电阻的改成与电路板元件外形一样的1，2，3即可。

ｌ、制作物理边框 封闭的物理边框对以后的元件布局、走线来说是个基本平台，也对自动布局起着约束作用，否则，从原理图过来的元件会不知所措的。但这里一定要注意精确，否则以后出现安装问题麻烦可就大了。还有就是拐角地方最好用圆弧，一方面可以避免尖角划伤工人，同时又可以减轻应力作用。以前我的一个产品老是在运输过程中有个别机器出现面壳ＰＣＢ板断裂的情况，改用圆弧后就好了。 ２、元件和网络的引入 把元件和网络引人画好的边框中应该很简单，但是这里往往会出问题，一定要细心地按提示的错误逐个解决，不然后面要费更大的力气。这里的问题一般来说有以下一些： 元件的封装形式找不到，元件网络问题，有未使用的元件或管脚，对照提示这些问题可以很快搞定的。 ３、元件的布局 元件的布局与走线对产品的寿命、稳定性、电磁兼容都有很大的影响，是应该特别注意的地方。一般来说应该有以下一些原则： ３．ｌ放置顺序 先放置与结构有关的固定位置的元器件，如电源插座、指示灯、开关、连接件之类，这些器件放置好后用软件的ＬＯＣＫ功能将其锁定，使之以后不会被误移动。再放置线路上的特殊元件和大的元器件，如发热元件、变压器、IC等。最后放置小器件。 ３．２注意散热 元件布局还要特别注意散热问题。对于大功率电路，应该将那些发热元件如功率管、变压器等尽量靠边分散布局放置，便于热量散发，不要集中在一个地方，也不要高电容太近以免使电解液过早老化。 ４、布线 布线原则 走线的学问是非常高深的，每人都会有自己的体会，但还是有些通行的原则的。 ◆高频数字电路走线细一些、短一些好 ◆大电流信号、高电压信号与小信号之间应该注意隔离（隔离距离与要承受的耐压有关，通常情况下在2ＫＶ时板上要距离2mm，在此之上以比例算还要加大，例如若要承受３ＫＶ的耐压测试，则高低压线路之间的距离应在3.5ｍｍ以上，许多情况下为避免爬电，还在印制线路板上的高低压之间开槽。） ◆两面板布线时，两面的导线宜相互垂直、斜交、或弯曲走线，避免相互平行，以减小寄生耦合；作为电路的输人及输出用的印制导线应尽量避兔相邻平行，以免发生回授，在这些导线之间最好加接地线。 ◆走线拐角尽可能大于９０度，杜绝９０度以下的拐角，也尽量少用９０度拐角 ◆同是地址线或者数据线，走线长度差异不要太大，否则短线部分要人为走弯线作补偿 ◆走线尽量走在焊接面，特别是通孔工艺的ＰＣＢ ◆尽量少用过孔、跳线 ◆单面板焊盘必须要大，焊盘相连的线一定要粗，能放泪滴就放泪滴，一般的单面板厂家质量不会很好，否则对焊接和ＲＥ－ＷＯＲＫ都会有问题 ◆大面积敷铜要用网格状的，以防止波焊时板子产生气泡和因为热应力作用而弯曲，但在特殊场合下要考虑ＧＮＤ的流向，大小，不能简单的用铜箔填充了事，而是需要去走线 ◆元器件和走线不能太靠边放，一般的单面板多为纸质板，受力后容易断裂，如果在边缘连线或放元器件就会受到影响 ◆必须考虑生产、调试、维修的方便性 对模拟电路来说处理地的问题是很重要的，地上产生的噪声往往不便预料，可是一旦产生将会带来极大的麻烦，应该未雨绸缎。对于功放电路，极微小的地噪声都会因为后级的放大对音质产生明显的影响；在高精度Ａ／Ｄ转换电路中，如果地线上有高频分量存在将会产生一定的温漂，影响放大器的工作。这时可以在板子的４角加退藕电容，一脚和板子上的地连，一脚连到安装孔上去（通过螺钉和机壳连），这样可将此分量虑去，放大器及ＡＤ也就稳定了。 另外，电磁兼容问题在目前人们对环保产品倍加关注的情况下显得更加重要了。一般来说电磁信号的来源有３个：信号源，辐射，传输线。晶振是常见的一种高频信号源，在功率谱上晶振的各次谐波能量值会明显高出平均值。可行的做法是控制信号的幅度，晶振外壳接地，对干扰信号进行屏蔽，采用特殊的滤波电路及器件等。 需要特别说明的是蛇形走线，因为应用场合不同其作用也是不同的，在电脑的主板中用在一些时钟信号上，如 ＰＣＩＣｌｋ、ＡＧＰ-Ｃｌｋ，它的作用有两点：１、阻抗匹配 ２、滤波电感。 对一些重要信号，如 ＩＮＴＥＬＨＵＢ架构中的ＨＵＢＬｉｎｋ，一共１３根，频率可达２３３ＭＨＺ，要求必须严格等长，以消除时滞造成的隐患，这时，蛇形走线是唯一的解决办法。 一般来讲，蛇形走线的线距＞＝２倍的线宽；若在普通PCB板中，除了具有滤波电感的作用外，还可作为收音机天线的电感线圈等等。 ５、调整完善 完成布线后，要做的就是对文字、个别元件、走线做些调整以及敷铜（这项工作不宜太早，否则会影响速度，又给布线带来麻烦），同样是为了便于进行生产、调试、维修。 敷铜通常指以大面积的铜箔去填充布线后留下的空白区，可以铺ＧＮＤ的铜箔，也可以铺ＶＣＣ的铜箔（但这样一旦短路容易烧毁器件，最好接地，除非不得已用来加大电源的导通面积，以承受较大的电流才接ＶＣＣ）。包地则通常指用两根地线（ＴＲＡＣ）包住一撮有特殊要求的信号线，防止它被别人干扰或干扰别人。 如果用敷铜代替地线一定要注意整个地是否连通，电流大小、流向与有无特殊要求，以确保减少不必要的失误。 ６、检查核对网络 有时候会因为误操作或疏忽造成所画的板子的网络关系与原理图不同，这时检察核对是很有必要的。所以画完以后切不可急于交给制版厂家，应该先做核对，后再进行后续工作。 ７、使用仿真功能 完成这些工作后，如果时间允许还可以进行软件仿真。特别是高频数字电路，这样可以提前发现一些问题，大大减少以后的调试工作量。 自动布线和手工调整 1、点击菜单命令Auto Route/Setup 对自动布线功能进行设置 选中除了Add Testpoints 以外的所有项，特别是选中其中的Lock All Pre-Route 选项，Routing Grid 可选1mil 等。自动布线开始前PROTEL 会给你一个推荐值可不去理它或改为它的推荐值，此值越小板越容易100%布通，但布线难度和所花时间越大。 2、点击菜单命令Auto Route/All 开始自动布线 假如不能完全布通则可手工继续完成或UNDO 一次（千万不要用撤消全部布线功能，它会删除所有的预布线和自由焊盘、过孔）后调整一下布局或布线规则，再重新布线。完成后做一次DRC，有错则改正。布局和布线过程中，若发现原理图有错则应及时更新原理图和网络表，手工更改网络表（同第一步），并重装网络表后再布。 3、对布线进行手工初步调整 需加粗的地线、电源线、功率输出线等加粗，某几根绕得太多的线重布一下，消除部分不必要的过孔，再次用VIEW3D 功能察看实际效果。手工调整中可选Tools-Density Map 查看布线密度，红色为最密，黄色次之，绿色为较松，看完后可按键盘上的End 键刷新屏幕。红色部分一般应将走线调整得松一些，直到变成黄色或绿色。 切换到单层显示模式下（点击菜单命令Tools/Preferences，选中对话框中Display栏的Single Layer Mode）将每个布线层的线拉整齐和美观。手工调整时应经常做DRC，因为有时候有些线会断开而你可能会从它断开处中间走上好几根线，快完成时可将每个布线层单独打印出来，以方便改线时参考，其间也要经常用3D显示和密度图功能查看。最后取消单层显示模式，存盘。 如果器件需要重新标注可点击菜单命令Tools/Re-Annotate 并选择好方向后，按OK钮。 并回原理图中选Tools-Back Annotate 并选择好新生成的那个*.WAS 文件后，按OK 钮。原理图中有些标号应重新拖放以求美观，全部调完并DRC 通过后，拖放所有丝印层的字符到合适位置。 注意字符尽量不要放在元件下面或过孔焊盘上面。对于过大的字符可适当缩小，DrillDrawing 层可按需放上一些坐标（Place-Coordinate）和尺寸（（Place-Dimension）。 最后再放上印板名称、设计版本号、公司名称、文件首次加工日期、印板文件名、文件加工编号等信息（请参见第五步图中所示）。并可用第三方提供的程序来加上图形和中文注释如BMP2PCB.EXE 和宏势公司POTEL99 和PROTEL99SE 专用PCB 汉字输入程序包中的FONT.EXE 等。 对所有过孔和焊盘补泪滴 补泪滴可增加它们的牢度，但会使板上的线变得较难看。顺序按下键盘的S 和A 键（全选），再选择Tools-Teardrops，选中General 栏的前三个，并选Add 和Track 模式，如果你不需要把最终文件转为PROTEL 的DOS 版格式文件的话也可用其它模式，后按OK 钮。完成后顺序按下键盘的X 和A 键（全部不选中）。对于贴片和单面板一定要加。 放置覆铜区 将设计规则里的安全间距暂时改为0.5-1mm 并清除错误标记，选Place-Polygon Plane 在各布线层放置地线网络的覆铜（尽量用八角形，而不是用圆弧来包裹焊盘。最终要转成DOS 格式文件的话，一定要选择用八角形）。下图即为一个在顶层放置覆铜的设置举例： 设置完成后，再按OK 扭，画出需覆铜区域的边框，最后一条边可不画，直接按鼠标右键就可开始覆铜。它缺省认为你的起点和终点之间始终用一条直线相连，电路频率较高时可选Grid Size 比Track Width 大，覆出网格线。 相应放置其余几个布线层的覆铜，观察某一层上较大面积没有覆铜的地方，在其它层有覆铜处放一个过孔，双击覆铜区域内任一点并选择一个覆铜后，直接点OK，再点Yes 便可更新这个覆铜。几个覆铜多次反复几次直到每个覆铜层都较满为止。将设计规则里的安全间距改回原值。 最后再做一次DRC 选择其中Clearance Constraints Max/Min　Width Constraints Short Circuit Constraints 和Un-Routed Nets　Constraints 这几项，按Run DRC 钮，有错则改正。全部正确后存盘。 对于支持PROTEL99SE 格式（PCB4.0）加工的厂家可在观看文档目录情况下，将这个文件导出为一个*.PCB 文件；对于支持PROTEL99 格式（PCB3.0）加工的厂家，可将文件另存为PCB 3.0 二进制文件，做DRC。通过后不存盘退出。在观看文档目录情况下，将这个文件导出为一个*.PCB 文件。由于目前很大一部分厂家只能做DOS 下的PROTEL AUTOTRAX 画的板子，所以以下这几步是产生一个DOS 版PCB 文件必不可少的： 1、将所有机械层内容改到机械层1，在观看文档目录情况下，将网络表导出为*.NET 文件，在打开本PCB 文件观看的情况下，将PCB 导出为PROTEL PCB 2.8 ASCII FILE 格式的*.PCB 文件。 2 、用PROTEL FOR WINDOWS PCB 2.8 打开PCB 文件，选择文件菜单中的另存为，并选择Autotrax 格式存成一个DOS 下可打开的文件。 3、用DOS 下的PROTEL AUTOTRAX 打开这个文件。个别字符串可能要重新拖放或调整大小。上下放的全部两脚贴片元件可能会产生焊盘X-Y大小互换的情况，一个一个调整它们。大的四列贴片IC 也会全部焊盘X-Y 互换，只能自动调整一半后，手工一个一个改，请随时存盘，这个过程中很容易产生人为错误。PROTEL DOS 版可是没有UNDO 功能的。假如你先前布了覆铜并选择了用圆弧来包裹焊盘，那么现在所有的网络基本上都已相连了，手工一个一个删除和修改这些圆弧是非常累的，所以前面推荐大家一定要用八角形来包裹焊盘。这些都完成后，用前面导出的网络表作DRC Route 中的Separation Setup ，各项值应比WINDOWS 版下小一些，有错则改正，直到DRC 全部通过为止。 也可直接生成GERBER 和钻孔文件交给厂家选File-CAM Manager 按Next>钮出来六个选项，Bom 为元器件清单表，DRC 为设计规则检查报告，Gerber 为光绘文件，NC Drill 为钻孔文件，Pick Place 为自动拾放文件，Test Points 为测试点报告。选择Gerber 后按提示一步步往下做。其中有些与生产工艺能力有关的参数需印板生产厂家提供。直到按下Finish 为止。在生成的Gerber Output 1 上按鼠标右键，选Insert NC Drill 加入钻孔文件，再按鼠标右键选Generate CAM Files 生成真正的输出文件，光绘文件可导出后用CAM350 打开并校验。注意电源层是负片输出的。 发Email 或拷盘给加工厂家，注明板材料和厚度（做一般板子时，厚度为1.6mm，特大型板可用2mm，射频用微带板等一般在0.8-1mm 左右，并应该给出板子的介电常数等指标）、数量、加工时需特别注意之处等。Email发出后两小时内打电话给厂家确认收到与否。 产生BOM 文件并导出后编辑成符合公司内部规定的格式。 将边框螺丝孔接插件等与机箱机械加工有关的部分（即先把其它不相关的部分选中后删除），导出为公制尺寸的AutoCAD R14 的DWG 格式文件给机械设计人员。 整理和打印各种文档。如元器件清单、器件装配图（并应注上打印比例）、安装和接线说明等 常用的PCB库文件 1.\library\pcb\connectors目录下的元件数据库所含的元件库含有绝大部分接插件元件的PCB封装 1）.D type connectors.ddb,含有并口，串口类接口元件的封装 2）.headers.ddb:含有各种插头元件的封装 2.\library\pcb\generic footprints目录下的数据库所含的元件库含有绝大部分的普通元件的PCB封状 1）.general ic.ddb,含有CFP，DIP，JEDECA，LCC，DFP，ILEAD，SOCKET，PLCC系列以及表面贴装电阻，电容等元件封装 2）.international rectifiers.ddb,含有IR公司的整流桥，二极管等常用元件的封装 3）.Miscellaneous.ddb,含有电阻，电容，二极管等的封装 4）.PGA.ddb,含有PGA封装 5）.Transformers.ddb,含有变压器元件的封装 6）.Transistors.ddb含有晶体管元件的封装 3.\library\pcb\IPC footprints目录下的元件数据库所含的元件库中有绝大部分的表面帖装元件的封装 PCB及电路抗干扰措施 印制电路板的抗干扰设计与具体电路有着密切的关系，这里仅就PCB抗干扰设计的几项常用措施做一些说明。 1.电源线设计 根据印制线路板电流的大小，尽量加租电源线宽度，减少环路电阻。同时、使电源线、地线的走向和数据传递的方向一致，这样有助于增强抗噪声能力。 2.地线设计的原则 (1)数字地与模拟地分开。若线路板上既有逻辑电路又有线性电路，应使它们尽量分开。低频电路的地应尽量采用单点并联接地，实际布线有困难时可部分串联后再并联接地。高频电路宜采用多点串联接地，地线应短而租，高频元件周围尽量用栅格状大面积地箔。 (2)接地线应尽量加粗。若接地线用很纫的线条，则接地电位随电流的变化而变化，使抗噪性能降低。因此应将接地线加粗，使它能通过三倍于印制板上的允许电流。如有可能，接地线应在2~3mm以上。 (3)接地线构成闭环路。只由数字电路组成的印制板，其接地电路布成团环路大多能提高抗噪声能力。 3.退藕电容配置 PCB设计的常规做法之一是在印制板的各个关键部位配置适当的退藕电容。退藕电容的一般配置原则是： (1)电源输入端跨接10~100uf的电解电容器。如有可能，接100uF以上的更好。 (2)原则上每个集成电路芯片都应布置一个0.01pF的瓷片电容，如遇印制板空隙不够，可每4~8个芯片布置一个1~10pF的钽电容。 (3)对于抗噪能力弱、关断时电源变化大的器件，如RAM、ROM存储器件，应在芯片的电源线和地线之间直接接入退藕电容。 (4)电容引线不能太长，尤其是高频旁路电容不能有引线。 (5)在印制板中有接触器、继电器、按钮等元件时．操作它们时均会产生较大火花放电，必须采用RC电路来吸收放电电流。一般R取1~2K，C取2.2~47UF。 (6) CMOS的输入阻抗很高，且易受感应，因此在使用时对不用端要接地或接正电源。 常用的PCB库文件 protel99： 1.\library\pcb\connectors目录下的元件数据库所含的元件库含有绝大部分接插件元件的PCB封装 1）.D type connectors.ddb,含有并口，串口类接口元件的封装 2）.headers.ddb:含有各种插头元件的封装 2.\library\pcb\generic footprints目录下的数据库所含的元件库含有绝大部分的普通元件的PCB封状 1）.general ic.ddb,含有CFP，DIP，JEDECA，LCC，DFP，ILEAD，SOCKET，PLCC系列以及表面贴装电阻，电容等元件封装 2）.international rectifiers.ddb,含有IR公司的整流桥，二极管等常用元件的封装 3）.Miscellaneous.ddb,含有电阻，电容，二极管等的封装 4）.PGA.ddb,含有PGA封装 5）.Transformers.ddb,含有变压器元件的封装 6）.Transistors.ddb含有晶体管元件的封装 3.\library\pcb\IPC footprints目录下的元件数据库所含的元件库中有绝大部分的表面帖装元件的封装