原创 dBc/Hz@100Hz 是什么意思

2013-7-30 09:56 2592 8 8 分类: FPGA/CPLD

 

-125dBc/Hz@100Hz  的含义是 在离开F0基准频率100HZ的地方,也就是说在F0+100HZ或F0-100HZ处的信号功率比F0处弱105DB, 其中,dBc是以dB为单位的该频率处功率与基准处功率的差值。
  计算方法如下:125DBC/HZ=105DBC + 10 log (100HZ) 
同理 140DBC/HZ=110 + 10 log (1KZ).  基准频率信号强度为基准,还加上“-”号。
就是 -125dBc/Hz@100Hz 和-140dBc/Hz@KHz。它门的区别是1KHZ处噪声信号功率比100HZ处还要小5DB.

 

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