关于FPGA和CPLD:
1.CPLD早出来,是基于乘积式的
FPGA晚出来,是基于查表式的,
就是说内部结构不一样
2.乘积式对于每次输入都很勤劳的算一遍
查表式根据输入查找对应的结果,是很偷懒的一种
查表式对应的结果哪里来?
就是由EDA软件来算的,最后将得到的结果配置到FPGA里.
由此可以理解为FPGA就是一个RAM
3.既然是RAM,FPGA就需要配置芯片(譬如FLASH),CPLD不要
4.FPGA门电路数量通常比CPLD多
5.CPLD内部延时固定,FPGA内部延时不固定(在几ns之间变化)
6.如果用于实现组合逻辑,多用CPLD;
用于实现时序逻辑,多用FPGA
当然都用FPGA也可以,不过两者各有各自发挥的优势(价格,功耗等方面)
1.CPLD早出来,是基于乘积式的
FPGA晚出来,是基于查表式的,
就是说内部结构不一样
2.乘积式对于每次输入都很勤劳的算一遍
查表式根据输入查找对应的结果,是很偷懒的一种
查表式对应的结果哪里来?
就是由EDA软件来算的,最后将得到的结果配置到FPGA里.
由此可以理解为FPGA就是一个RAM
3.既然是RAM,FPGA就需要配置芯片(譬如FLASH),CPLD不要
4.FPGA门电路数量通常比CPLD多
5.CPLD内部延时固定,FPGA内部延时不固定(在几ns之间变化)
6.如果用于实现组合逻辑,多用CPLD;
用于实现时序逻辑,多用FPGA
当然都用FPGA也可以,不过两者各有各自发挥的优势(价格,功耗等方面)
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用户226935 2009-05-10 20:15
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