原创 低功耗模拟前端电路设计

 超低功耗、高集成的模拟前端芯片ＭＡＸ５８６５是针对便携式通信设备例如手机、ＰＤＡ、ＷＬＡＮ以及３Ｇ无线终端　而设计的，芯片内部集成了双路８位接收ＡＤＣ和双路１０位发送ＤＡＣ，可在４０Ｍｓｐｓ转换速率下提供超低功耗与更高的动态性能。芯片中的ＡＤＣ模拟输入放大器为全差分结构，可以接受１ＶＰ－Ｐ满量程信号；而ＤＡＣ模拟输出则是全差分信号，在１．４Ｖ共模电压下的满量程输出范围为４００ｍＶ。利用兼容于ＳＰＩＴＭ和ＭＩＣＲＯＷＩＲＥＴＭ的３线串行接口可对工作模式进行控制，并可进行电源管理，同时可以选择关断、空闲、待机、发送、接收及收发模式。通过３线串口将器件配置为发送、接收或收发模式，可使ＭＡＸ５８６５工作在ＦＤＤ或ＴＤＤ系统。在ＴＤＤ模式下，接收与发送ＤＡＣ可以共用数字总线，并可将数字Ｉ／Ｏ的数目减少到一组１０位并行多路复用总线；而在ＦＤＤ模式下，ＭＡＸ５８６５的数字Ｉ／Ｏ可以被配置为１８位并行多路复用总线，以满足双８位ＡＤＣ与双１０位ＤＡＣ的需要。

１ ＭＡＸ５８６５的工作原理

图１所示为ＭＡＸ５８６５内部结构原理框图，其中，ＡＤＣ采用七级、全差分、流水线结构，可以在低功耗下进行高速转换。每半个时钟周期对输入信号进行一次采样。包括输出锁存延时在内，通道Ｉ的总延迟时间为５个时钟周期，而通道Ｑ则为５．５个时钟周期，图２给出了ＡＤＣ时钟、模拟输入以及相应输出数据之间的时序关系。ＡＤＣ的满量程模拟输入范围为ＶＲＥＦ，共模输入范围为ＶＤＤ／２±０．２Ｖ。ＶＲＥＦ为ＶＲＥＦＰ与ＶＲＥＦＮ之差。由于ＭＡＸ５８６５中的ＡＤＣ前端带有宽带Ｔ／Ｈ放大器，因此，ＡＤＣ能够跟踪并采样／保持高频模拟输入＞奈魁斯特频率　。使用时可以通过差分方式或单端方式驱动两路ＡＤＣ输入ＩＡ＋ ＱＡ＋ ＩＡ－与ＱＡ－　。为了获得最佳性能，应该使ＩＡ＋与ＩＡ－以及ＱＡ＋与ＱＡ－间的阻抗相匹配，并将共模电压设定为

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