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    2015-7-25 10:47
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    上拉电阻和下拉电阻的选型和计算 常见各类技术资料上,有些技术规范写道“无用的管脚不允许悬空状态,必须接上拉或下拉电阻以提供确定的工作状态”。这个提法基本是对的,但也不全对。下面详细加以说明。   管脚上拉下拉电阻设计出发点有两个: 一个是在正常工作或单一故障状态下,管脚均不应出现不定状态,如接头脱落后导致的管脚悬空; 二是从功耗的角度考虑,就是在长时间的管脚等待状态下,管脚端口的电阻上不应消耗太多电流,尤其是对电池供电设备。   从抗扰的角度,信号端口优选上拉电阻。上拉电阻时,在待机状态下,源端输入常为高阻态,如果没有上拉电阻或下拉电阻,输入导线呈现天线效应,一旦管脚受到辐射干扰,管脚输入状态极容易被感应发生变化。所以,这个电阻是肯定要加的。下一个问题就是加上拉还是下拉。 如果加了下拉,在平常状态下,输入表现为低电平,但辐射干扰进来后,会通过下拉电阻泻放到地,就会发生从 Low — High 的一个跳变,产生误触发。相当于一个乞丐,你给了他 10 万元,他的生活方式就会从穷人到富人发生一个改变。 但如果加了上拉电阻,在平常状态下,输入表现为高电平,辐射干扰进来后,如果低也没关系,上拉电阻会将输入端钳位在高电平,如果辐射干扰强,超过了 Vcc 的电平,导线上的高电平干扰会通过上拉电阻泻放到 Vcc 上去,无论怎样干扰,都只会发生 High — Higher 的变化,不会产生误触发。相当于人家本来是一个富豪,你给了他 10 万元,他的生活方式不会发生任何的改变。     图 1 和图 2 是干扰状态下的电平示意图。图 2 中的低电平由 VL 变为 VL+ Δ V 时,产生了从低电平到高电平的跳变,有可能使后级电路误动作的风险。     下一个问题就是,确定了用上拉电阻后,是不是上拉电阻就可以随便选了呢?答案当然是“ no ”。(如图 3 )       在前极输出高电平时, Vout 输出电流, U 为高电平。有两种情况:   A 、当 I0   = I1   + I2     这种情况下, RL1 和 RL2 两个负载不会通过 R 取电流,因此对 R 阻值大小要求不高,通常 4.7 K Ω Ω即可。此时 R 的主要作用是增加信号可靠性,当 Vout 连线松动或脱落时,抑制电路产生鞭状天线效应吸收干扰。 B 、当 I0   I1   + I2     I0   +I= I1   + I2     U=VCC-IR     U= VHmin     由以上三式计算得出, R=(VCC- VHmin )/I     其中, I0 、 I1 、 I2 都是可以从 datasheet 查到的, I 就可以求出来, VHmin 也是可以查到的。       当前极 Vout 输出低电平时,各管脚均为灌电流,则:     I ’ = I1 ’ + I2 ’ +I0 ’     U ’ =VCC-I ’ R     U ’ = VLmax 以上三式可以得出: R=(VCC- VLmax )/I ’       由以上二式计算出 R 的上限值和下限值,从中取一个较靠近中间状态的值即可。注意,如果负载的个数大小不定的话,要按照最坏的情况计算,上限值要按负载最多的时候计算,下限值要按负载最少的计算。       另一种选择方式是基于功耗的考虑。根据电路实际应用时,输出信号状态的频率或时间比选择。若信号 Vout 长期处于低电平,宜选择下拉电阻;若长期处于高电平,宜选择上拉电阻。为的是静态电流小。     
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    2015-6-1 15:34
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    原博文见:http://bbs.ednchina.com/BLOG_ARTICLE_3019220.HTM 1.学会解决时序违规的主要原则,方法。 2.学会了用locate来查看时序节点路径的小技巧   3.遗留的问题是:最后他说寄存器重定时的方法不具体,不知道这个有什么作用?