原创 直流稳压电源

2007-5-16 23:10 5073 6 7 分类: 模拟


2006-4-18

直流稳压电源


概述:在电子电路中,通常都需要电压稳定的直流电源供电。小功率的稳压电源的组成如下图所示,它由电源变压器、整流电路、滤波电路和稳压电路四部分组成。


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  直流稳压电源的技术指标特性指标:输入电压、输出电压、输出电流、输出电压范围


  质量指标:稳压系数、温度系数、输出电阻、纹波电压,它们的定义式为: 点击看大图


  其中稳压系数γ的定义是负载固定时输出电压的相对变化量与稳压电路的输入电压的相对变化量之比。温度系数ST是反映温度变化对输出电压的影响;输出电阻RO反映负载电流变化对输出电压的影响 ;纹波电压是指稳压电路输出端交流分量的有效值,它表示输出电压的微小波动。可见,上述系数越小,输出电压越稳定。


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第二节 小功率整流滤波电路


一、单相整流电路


  整流电路是小功率直流稳压电路电源的组成部分。其主要功能是利用二极管的单向导电性,将正弦交流电转变成单方向的脉动直流电  。常用的整流电路有:


1、半波整流电路


  半波整流就是利用二极管的单向导电性能,使经变压器出来的电压Vo只有半个周期可以到达负载,造成负载电压VL是单方向的脉动直流电压。


   image153.gif


主要参数:


  image392.gif


2、全波整流整流电路


  利用副边有中心抽头的变压器和两个二极管构成如下图所示的全波整流电路。从图中可见,正负半周都有电流流过负载,提高了整流效率。


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全波整流的特点:


  输出电压VO高;脉动小;正负半周都有电流供给负载,因而变压器得到充分利用,效率较高。


主要参数:


  image393.gif 


3、桥式整流电路


  桥式整流属于全波整流,它不是利用副边带有中心抽头的变压器,而是用四个二极管接成电桥形式,使在电压V2的正负半周均有电流流过负载,在负载形成单方向的全波脉动电压。


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主要参数:

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二、滤波电路


  从上面的分析可以看出,整流电路输出波形中含有较多的纹波成分,与所要求的波形相去甚远。所以通常在整流电路后接滤波电路以滤去整流输出电压的纹波。滤波电路常有电容滤波,电感滤波和RC滤波等。


1、电容滤波电路


    image156.gif


  图10.5分别是桥式整流电容滤波电路和它的部分波形。这里假设t<0时,电容器C已经充电到交流电压V2的最大值(如波形图所示)。


  结论1:由于电容的储能作用,使得输出波形比较平滑,脉动成分降低输出电压的平均值增大。


  image394.gif


  当RLC的值适当,且整流电路的内阻较小(几欧)时,


  image395.gif


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  结论2:从图10.6可看出,滤波电路中二极管的导电角小于180o ,导电时间缩短。因此,在短暂的导电时间内流过二极管很大的冲击电流,必须选择较大容量的二极管。


  在纯电阻负载时:image396.gif


  有电容滤波时:image397.gif


  结论3:电容放电的时间τ=RLC越大,放电过程越慢,输出电压中脉动(纹波)成分越少,滤波效果越好。一般取τ≥(3~5)T/2,T为电源交流电压的周期。


2、电感滤波电路


  电感滤波电路利用电感器两端的电流不能突变的特点,把电感器与负载串联起来,以达到使输出电流平滑的目的。从能量的观点看,当电源提供的电流增大(由电源电压增加引起)时,电感器L把能量存储起来;而当电流减小时,又把能量释放出来,使负载电流平滑,所以电感L有平波作用。


   image158.gif


       image159.gif


  优点:整流二极管的导电角大,峰值电流小,输出特性较平坦。


  缺点:存在铁心,笨重、体积大,易引起电磁干扰,一般只适应于低电压、大电流的场合。


例10.1.1整流滤波电路如图所示,已知V1是220V交流电源,频率为50Hz,要求直流电压VL=30V,负载电流IL=50mA。 试求电源变压器副边电压v2的有效值,选择整流二极管及滤波电容。


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解:(1)变压器副边电压的有效值


   image398.gif


  (2)选择整流二极管流经整流二极管的平均电流为


     image399.gif


  二极管承受的最大反向电压为 image400.gif


  (3)选择滤波电容


  因为负载电阻 image401.gif


  image402.gif


  由此得滤波电容 image403.gif


  考虑到电网电压波动±10%,则电容所承受的最高电压为


   image404.gif


因此选用标称值为68mF/50V的电解电容


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第三节 串联反馈式稳压电源


一、稳压管稳压电路


  最简单的稳压电路由稳压管组成如图所示。从稳压管的特性可知,若能使稳压管始终工作在它的稳压区内,则VO.基本稳定在Vz左右。


        image161.gif

  当电网电压升高时,若要保持输出电压不变,则电阻器R上的压降应增大,即流过R的电流增大。这增大的电流由稳压管容纳,它的工作点将由b点移到C点,由特性曲线可知此时Vo≈Vz基本保持不变。


      image163.gif

  若负载电阻变小时,要保持输出电压不变, 负载电流要变大。由于VI保持不变,则流过电阻R的电流不变。此时负载需要增大的电流由稳压管调节出来,它的工作点将由b点移到a点。 所以,稳压管可认为是利用调节流过自身的电流大小 (端电压基本不变)来满足负载电流的改变,并和限流电阻R配合将电流的变化转化为电压的变化以适应电网电压的变化。


      image162.gif


  存在问题:电网电压不变时,负载电流的变化范围就是IZ的调节范围(几十mA),这就限制了负载电流I0的变化范围。 怎样才能扩大IO的变化范围?


二、串联反馈稳压电路


  射极输出电路( 如图10.13 )的输入是固定值的VZ ,因而输出电压VO=VZ-VBE也为固定值。当电网电压波动时,由于VZ基本不变,所以VO也基本不变,VI的变化由VCE调节,因此三极管被称为调整管。当RL变化引起IO的变化时,只要△IZ在稳压管的正常范围内, VZ就基本保持不变。即VO基本恒定。


      image164.gif


  该电路输出电流的变化可扩大为(1+β)△IZ, 因此称为扩流型稳压二极管电路;由于三极管与负载是串联的关系, 因此电路也称为串联型稳压电路。

  为了改进稳压性能和使输出电压可随意调节, 可引入深负反馈使输出电阻降低,引入可随意调节放大倍数的放大器以改变输出电压。


下面分几个方面进行分析:


电路组成:


  如图10.14所示的电路是由运放组成的串联反馈稳压电路。 它由基准电压、比较放大、调整管和取样电路四部分构成。


     image165.gif


稳压过程:image405.gif


稳压范围:image406.gif


  可见,该稳压电路输出电压的调整范围取决于R1/R2


三、三端集成稳压电路


1、三端固定式集成稳压器的封装和引脚功能


  以7800系列和7900系列为例,其封装形式和引脚功能如图所示。应用时必须注意引脚功能,不能接错,否则电路将不能正常工作,甚至损坏集成电路。


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2、三端可调式集成稳压器的封装和引脚功能


  电路结构、外接元件(以LM317为例)、外形封装和引脚功能如下图所示。应用时必须注意引脚功能,不能接错,否则电路将不能正常工作,甚至损坏集成电路。


   image167.gif


        image168.gif


四、三端集成稳压器的应用


1、三端固定式典型应用


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  典型应用电路如图10.18所示。图中C1、C2用于频率补偿,防止自激振荡和抑制高频干扰;C3采用电解电容, 以减少电源引入的低频干扰对输出电压的影响;D是保护二极管,当输入端短路时,给C3一个放电的通路,防止C3两端电压激穿调整管的发射结。 


  该电路要求:image407.gif


2、扩大输出电流的应用电路


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  需要大于0.1A的输出电流时, 可以采用其他型号的集成电路或使用如右图所示的扩流电路。该电路的输出电流I0=I01+I02


    image408.gif


  该电路具有过流保护功能, 正常工作时,T2、T3截止;当IO过流时,IO1增大, 限流电阻R3的压降增大使T3、T2相继导通, T1的VBE降低,限制了T1的IC1,保护T1不致因过流而损坏。


3、三端可调式集成稳压器的典型应用电路


  这类稳压器是依靠外接电阻来调节输出电压的,为保证输出电压的精度和稳定性,要选择精度高的电阻,同时电阻要紧靠稳压器,防止输出电流在连线上产生误差电压。 图所示为三端可调式稳压器的典型应用电路,其输出电压为:


  image409.gif


LM317的VREF=1.2V,Iadj=50mA,由于Iadj<<I1,所以


  image410.gif


4、三端可调双电源稳压电路


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  图10.20是由LMl17和LM137组成的正、负输出电压可调的稳压器。电路中的VREF=V31(或V21)=1.2V,R1和R1'=(120~240)Ω,为保证空载情况下输出电压稳定,R2和R2'不宜高于240Ω。 R2和R2'的大小根据输出电压调节范围确定。该电路输入电压们分别为±25V,则输出电压可调范围±(1.2V~20V)。


5、并联扩流型稳压电源


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  图10.21为并联扩流的稳压电路,它是用两个可调式稳压器LM317组成 。输人电压VI=25V, 输出电流I0=IO1+IO2=3A, 输出电压可调范围为(1.2V~22V )。 电路中的集成运放741是用来平衡两稳压器的输出电流的。如LM317-1输出电流Io1大于LM317-2输出电流IO2时,电阻R1上的电压降增加,运放的同相端电位VP(=VI-I1R1)降低,运放输出端电压VAO降低,通过调整端adj1使输出电压Vo下降,输出电流IO1减小,恢复平衡 ;反之亦然。改变电阻R5可调节输出电压的数值。





2005-8-28

TimerMode6_PWM.c(zz)

// timermode6_pwm.c
// Christian Kulig, 10/29/02
//
// This sample creates a PWM signal on port P0.7 using a standard timer. 
// It sets up the mode 6 (PWM mode) and varies the duty cycle.
 
#include <Reg932.h>     //Keil header file name
#include <stdio.h>
 
void msec(int x);
void init(void);
void brkrst_init(void);
void Timer1_init(void);

unsigned char n=0;
  
void main(void)
{
 init();    // configure ports
 brkrst_init();  // enable UART break-detect 
 Timer1_init();  // set up timer1 mode6 (PWM)

  while(1)
 { 
  for(n=0; n<255; n++)  // vary duty cycle
  {
   TH1=n; 
   msec(15);
  }
  msec(100);
 
  for(n=255; n>0; n--) 
  {
   TH1=n;
   msec(15);
  }
  msec(100);
 }  
}

void init(void)
{
 P0M1 = 0x00;    // push pull output
 P0M2 = 0xFF;

 ES = 1;      // enable UART interrupt
 EA = 1;
}   
 
void brkrst_init(void)   // This function allows ISP entry through the UART break detect
{
 AUXR1 |= 0x40;    // enable reset on break detect
 SCON = 0x50;    // select the BRG as UART baud rate source
 SSTAT = 0x00;
 BRGR0 = 0x70;    // 9600 BAUD at 11.0592 MHz
 BRGR1 = 0x04;
 BRGCON = 0x03;    // enable BRG
}

void UART(void) interrupt 4
{
 RI = 0;      // clear receive interrupt flag
}
 
void msec(int x)    // @ 11.0592 MHz
{
 int j=0;
 while(x>=0)
 {
  for (j=0; j<1350; j++);
  x--;
 } 
}

void Timer1_init(void)
{
 TMOD|=0x20;     // timer1 mode 6, PWM
 TAMOD|=0x10;
 TH1=200;     // duty cycle = 256-TH1
 AUXR1|=0x20;    // enable toggling pin P0.7
 TR1=1;      // start timer 1
}




2005-8-28

浅谈VHDL/Verilog的可综合性以及对初学者的一些建议ZT

一、HDL不是硬件设计语言 

过去笔者曾碰到过不少VHDL或Verilog HDL的初学者问一些相似的问题,诸如如何实现除法、开根号,如何写循环语句等等。在这个论坛上,也时常能看到一些网友提出这一类的问题。 

对于这些问题,首先要明确的是VHDL和Veriglog并非是针对硬件设计而开发的语言,只不过目前被我们用来设计硬件。HDL是Hardware Description Language的缩写,正式中文名称是“硬件描述语言”。也就是说,HDL并不是“硬件设计语言(Hardware Design Language)”。别看只差这一个单词,正是这一个单词才决定了绝大部分电路设计必须遵循RTL的模式来编写代码,而不能随心所欲得写仅仅符合语法的HDL代码。 

二、HDL的来历 

之所以是“硬件描述语言”,要从HDL的来历说起。 

VHDL于1980年开始在美国国防部的指导下开发,完成于1983年,并于1987年成为IEEE的标准。当初开发这种语言,是出于美国国防部采购电子设备的需要。美军的装备采购自私人企业,时常要面对这样一种风险:如果某种武器大量装备部队,而其中某个零件的供应商却在几年后倒闭了,那这种武器的再生产、维修和保养都会出现大问题。而电子设备、尤其是集成电路的内部结构较为复杂,若出现前面所说的情况要找其他公司生产代用品非常困难。于是美国防部希望供应商能以某种形式留下其产品的信息,以保证一旦其破产后能由其他厂商迅速生产出代用品。 

显然,当初的设计文档显然是不能交出来的,这在美国会涉及商业机密和知识产权问题。于是美国防部就想出了一种折衷的方法——描述硬件的语言,也就是VHDL。通过VHDL,供应商要把自己生产的集成电路芯片的行为描述出来:比如说,加了什么样的信号后过多少时间它能输出什么等等。这样,如果有必要让其他厂商生产代用品,他们只需照着VHDL文档,设计出行为与其相同的芯片即可。这样的代用品相当于是新厂商在不了解原产品结构的情况下独立设计的,所以不太会涉及知识侵权。 

Verilog HDL也形成于差不多的年代,是由Gateway Design Automation公司大约在1983年左右开发的。其架构同VHDL相似,但主要被用来进行硬件仿真。或许私人公司更注重实用,Verilog要比VHDL简洁得多。 

由此可见,这两种最流行的用于电路设计的语言,没有一种是为了设计硬件而开发的(更何况80年代还没有现在的那些功能强大的EDA软件呢)。因此,当初制订HDL语言标准的时候,并没有考虑这些代码如何用硬件来实现。换句话说,有些代码写起来简单,实现起来却可能非常复杂,或者几乎不可能实现。 

三、HDL代码的可综合性 

现在回到最初的问题上。为什么诸如除法、循环之类的HDL代码总是会出错? 

由上一部分可知,任何符合HDL语法标准的代码都是对硬件行为的一种描述,但不一定是可直接对应成电路的设计信息。行为描述可以基于不同的层次,如系统级,算法级,寄存器传输级(RTL)、门级等等。以目前大部分EDA软件的综合能力来说,只有RTL或更低层次的行为描述才能保证是可综合的。而众多初学者试图做的,却是想让软件去综合算法级或者更加抽象的硬件行为描述。 

比如说,要想实现两个变量相除的运算,若在代码中写下C=A/B,你将会发现只有一些模拟软件在前仿真中能正确执行这句代码,但几乎任何软件都不能将其综合成硬件。不要怪软件太笨。试想一下,如果我们自己笔算除法是怎么做的?从高位到低位逐次试除、求余、移位。试除和求余需要减法器,商数和余数的中间结果必须有寄存器存储;而此运算显然不能在一个时钟周期里完成,还需要一个状态机来控制时序。一句简单的C=A/B同所有这些相比显得太抽象,对于只能接受RTL或更低层次描述的EDA软件来说确实太难实现。而如果代码是类似于(Verilog) 
always @(posedge clk) 
c<=A/B; 这样的,要求除法在一个时钟延上完成,那更是不可能实现的。(注:有些FPGA的配套软件提供乘除法的运算模块,但也只能支持直接调用,不支持把形如C=A/B的语句综合成除法模块。) 

又比如,一个很多初学者常见的问题是试图让HDL进行循环运算,形同(Verilog): 
for (i=0; iparity = parity xor data

一些功能比较简单的综合软件会完全拒绝综合循环语句;而一些功能较强的软件仅当wordlength是常数的时候能综合;当wordlength为变量时,任何软件都不能综合上面的语句。这是因为硬件规模必须是有限的、固定的。当综合软件遇到循环语句时,总是将其展开成若干条顺序执行的语句,然后再综合成电路。若wordlength是常数,则展开的语句数是确定的,具有可综合性;而若它是变量时,展开的语句数不确定,对应的硬件电路数量也不能确定,无法被综合。或许有人说用计数器就能实现变量循环,但这情形又和上面的除法运算相同。那需要额外的硬件,用来存储中间结果和进行时序控制,象上面那样的循环语句对此描述得太抽象,软件接受不了。 

四、如何判断自己写的代码是可综合的? 

用一句简单的话概括:电脑永远没有你聪明。具体来说,通常EDA软件对HDL代码的综合能力总是比人差。对于一段代码,如果你不能想象出一个较直观的硬件实现方法,那EDA软件肯定也不行。比如说,加法器、多路选择器是大家都很熟悉的电路,所以类似A+B-C,(A>B)?Cbiggrin.gif这样的运算一定可以综合。而除法、开根、对数等等较复杂的运算,必须通过一定的算法实现,没有直观简单的实现方法,则可以判断那些计算式是不能综合的,必须按它们的算法写出更具体的代码才能实现。此外,硬件无法支持的行为描述,当然也不能被综合(比如想在FPGA上实现DDR内存那样的双延触发逻辑,代码很容易写,但却不能实现)。 

不过,这样的判断标准非常主观模糊,遇到具体情况还得按设计人员自己的经验来判断。如果要一个相对客观的标准,一般来说:在RTL级的描述中,所有逻辑运算和加减法运算、以及他们的有限次组合,基本上是可综合的,否则就有无法综合的可能性。当然,这样的标准仍然有缺陷,更况且EDA的技术也在不断发展,过去无法综合的代码或许将来行,某些软件不支持的代码换个软件或许行。比如固定次数的循环,含一个常数参数的乘法运算等等,有些EDA软件支持对它们的综合,而有些软件不行。 

所以,正确的判断仍然要靠实践来积累经验。当你可以较准确判断代码的可综合性的时候,你对HDL的掌握就算完全入门了。 

作者:董培良 
电机和电子工程系博士生 
英国University of Nottingham 



2005-5-12

无题

今天本来有8节课的,可是只上2节课.那两节课可真难熬,整整花了两节课来做作业.冥思苦想之制,使出本人看家本领鬼画弧似的草草了事.`````````````````````
跟同学聊天聊的太久啦,没时间写啦.算啦,明天接着写


2005-5-11

blog第一天

    其实做网民已经很久了,不过听说blog还是一年前的事.最近学校里面有个blog,本想在那里留下自己的回忆,但仔细想想,我的第一次怎么可以轻易的献出去了.于是决定献给中国博客这个大家庭.
    我想象中的blog是个人的私人日记,记录个人的点点滴滴,酸甜苦辣.我没有写日记的习惯,不过我想既然有了这个blog,我会尽最大的努力去记录发生在我身边的点点滴滴的.让这点点滴滴成为美好的回忆.让那一瞬间成为永恒.
    blog发展的很快,成为网民交流一个大平台.与实时交流工具(如QQ/popo/bbs等等)在网民中占有不可替代的地位.随着高校bbs论坛实名制的执行,blog有着更大的发展空间.
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用户414506 2012-5-21 09:09

怎么没看到图片呀?
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