原创 upsd3354的JTAG调试

2009-2-16 15:01 2232 4 7 分类: MCU/ 嵌入式

本人最近做的项目中用到一款st的upsd3354,51内核的,当时老板选这款芯片的原因就是考虑兼容性,缩短开发周期的,因为我们之前的这款产品用的是51的,但结果却事与愿违,想当初还不如用stm32系列的!就算不考虑性价比的话,相关的资料stm32也要多的多,本人E文水平很差,也许是因为国内用的少的缘故,相关中文资料很少,相对来说3200系列的还多一点,不过3200系列的没有JTAG调试功能,所以到现在为止,jtag调试问题还是没有完全解决!希望有高手能指点一下,另外不得不说的是这款芯片的国内代理商的技术支持真是垃圾啊!虽然3354的性能没说的!下面是3354的基本介绍!


Fast 8032 MCU with Programmable Logic


FEATURES SUMMARY
■ FAST 8-BIT TURBO 8032 MCU, 40MHz
– Advanced core, 4-clocks per instruction
– 10 MIPs peak performance at 40MHz (5V)
– JTAG Debug and In-System
Programming
– Branch Cache & 6 instruction Prefetch
Queue
– Dual XDATA pointers with auto incr & decr
– Compatible with 3rd party 8051 tools
■ DUAL FLASH MEMORIES WITH MEMORY
MANAGEMENT
– Place either memory into 8032 program
address space or data address space
– READ-while-WRITE operation for In-
Application Programming and EEPROM
emulation
– Single voltage program and erase
– 100K guaranteed erase cycles, 15-year
retention
■ CLOCK, RESET, AND SUPPLY
MANAGEMENT
– SRAM is Battery Backup capable
– Flexible 8-level CPU clock divider register
– Normal, Idle, and Power Down Modes
– Power-on and Low Voltage reset
supervisor
– Programmable Watchdog Timer
■ PROGRAMMABLE LOGIC, GENERAL
PURPOSE
– 16 macrocells
– Create shifters, state machines, chipselects,
glue-logic to keypads, panels,
LCDs, others
■ COMMUNICATION INTERFACES
– I2C Master/Slave controller, 833KHz
– SPI Master controller, 10MHz
– Two UARTs with independent baud rate
– IrDA protocol support up to 115K baud
– Up to 46 I/O, 5V tolerant on 3.3V
uPSD33xxV
Figure 1. Packages
■ A/D CONVERTER
– Eight Channels, 10-bit resolution, 6μs
■ TIMERS AND INTERRUPTS
– Three 8032 standard 16-bit timers
– Programmable Counter Array (PCA), six
16-bit modules for PWM, CAPCOM, and
timers
– 8/10/16-bit PWM operation
– 11 Interrupt sources with two external
interrupt pins
■ OPERATING VOLTAGE SOURCE (±10%)
– 5V devices use both 5.0V and 3.3V
sources
– 3.3V devices use only 3.3V source


我用的是软件是keilc51,下载调试用的是ulink2。upsd3354和一般的单片机的区别就是多了外围的pld电路,另外片内的flash,sram容量都比较大!,比较困难的也就是配置pa-pd口的管脚和flashram的地址分配,我们用的是数据块大,程序块小,所以main flash放数据,secondflash放程序,upsd3354没有p2口,16位地址总线的高位地址就用pb口代替,因为要读取外部的大量数据,pa口也扩展成了地址线,片内是16位的地址总线,寻址范围为64k,所以片内的mainflsh要分页处理,而且片内的flsh地址和sram地址重合,片内片外的数据存储器地址也有重合,处理区分都是用的分页寄存器来处理的,另外还有一个比较重要的控制寄存器vm控制wr,rd访问!用在iap时!说了这么多还没有讲到jtag的问题,现在jtag擦除,下载程序都没有问题,就是调试时,程序总是不能从头文件(A51后缀),跳到从源程序上,所以调试时进不了源程序调试界面,都是进的反汇编界面,这样就麻烦的多,不知高手们有什么解决办法没!因为反汇编的调试界面看着都头大!就先说这么多,希望高手能指点一下,反正现在的感觉就是无助啊!给技术支持打电话,他们总是含混不清的! 

文章评论3条评论)

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用户212675 2009-8-10 17:24

参考一下,有一款国内的芯片包含1T 8051和1024逻辑单元的芯片。 网站: www.agatelogic.com Copy的芯片介绍 FP-MCU系列是Agate Logic独创的现场可编程微控制器芯片套件(FP-MCU简介)。该系列产品将微控制器硬核(MCU) 和现场可编程逻辑门阵列(FPGA)融合在一起,为用户提供了一个全新的可编程、可配置的嵌入式应用开发系统。 FP-MCU系列芯片是微控制器和FPGA的完美结合。AG1F1内嵌了高性能8051微控制器硬核,FPGA功能强大,而且拥有稳定的存储器模块和锁相环时钟控制模块,因此与ASIC和FPGA相比,AG1F1能够为设计者提供更高的集成度以及更好的性价比等众多优势。 产品特点: 内嵌高性能8051微控制器硬核 - 优化的8051微控制器体系结构,指令集与工业标准兼容 - 每条指令仅需1到4个时钟周期 - 128字节内部数据存储器,8K字节片上数据存储器,32K字节片上程序存储器 - 4组8位宽输入输出端口 - 2个16位定时器/计数器 - 5个中断源 - 可配置串行口 - 看门狗定时电路 - 平均性能(0.5-1)MIPS/MHz,为普通8051的8.4倍左右- 最大工作频率50MHz - 支持ISD51在线调试 多达1,024个现场可编程逻辑单元 - 基于4输入查找表(LUT)+D触发器结构 - 专用算术逻辑电路 - 层次化结构布线资源 低成本的配置方案 - 提供通过外部SPI FLASH存储器进行单机操作的低成本配置方案 - 提供业界标准的JTAG配置方案 4块9Kb可配置DPRAM - 支持True Dual-Port RAM - 字节使能信号 - 支持校验位 - 数据宽度可配置 1个PLL锁相环 - 两路时钟输出 - 可配置倍频、分频、相移 - 时钟输入频率范围:2MHz-50MHz - 时钟输出频率范围:2.34MHz-450MHz 电压特性 - 核心电压:1.2V - 支持单端I/0标准LVCMOS/LVTTL u3.3/2.5/1.8/1.5、PCI、HSTL、SSTL,以及差分I/O标准LVDS LQFP144封装,多达100个用户I/O

用户1179377 2009-7-13 10:56

使用IAP一定要注意SRAM,外设,upsd空间,Flash(当作数据区访问时)的优先级…… 还有就是bootloader和用户程序分别对应的映射关系,不对比清楚是不可能往下做的。 不过PSDSoft已经做得足够好了,如果映射关系理解了,勾勾选选几分钟就搞定了。

用户1179377 2009-7-13 10:47

upsd3354是很好用的——只要硬件电路没抛出参考设计的范围。大容量Flash、SRAM是亮点,远程升级IAP对于产品很分散的监控应用来说是必不可少的——可以避免程序升级带来的麻烦和成本。 不过看你的描述应该是KEIL工程没设置好,应该把option->output标签里的: debug information,brower information都勾选上。
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