原创 8421码和格雷码编码的38译码器

 2011-5-4 15:45  3327 10 10 分类: FPGA/CPLD

使用环境：Quartus II 8.0 + DE2(Cyclone II EP2C35F627C6)

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//Copyright
//All right reserved
//File name: decoder3to8.v
//Author: dpc525
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//Major funtion:
//
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//Note:
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//Modification history :
// Mod. Date :2011-5-4
// V1.0: Initial Revision
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//8421码
module decoder3to8(data_in ,EN ,data_out );

input [2:0] data_in ;
input EN ;
output [7:0] data_out ;
reg [7:0] data_out ;

always @(data_in or EN )
begin
data_out = {8{1'b0}};
if (EN == 1)
begin
case (data_in )
3'b000 : data_out = 8'b0000000;
3'b001 : data_out = 8'b0000001;
3'b010 : data_out = 8'b0000010;
3'b011 : data_out = 8'b0000100;
3'b100 : data_out = 8'b0001000;
3'b101 : data_out = 8'b0010000;
3'b110 : data_out = 8'b0100000;
3'b111 : data_out = 8'b1000000;
default : data_out = {8{1'b0}};
endcase
end
end

endmodule

8421码仿真时序图

//格雷码译码

module decoder3to8(data_in ,EN ,data_out );

input [2:0] data_in ;
input EN ;
output [7:0] data_out ;
reg [7:0] data_out ;

always @(data_in or EN )
begin
data_out = {8{1'b0}};
if (EN == 1)
begin
case (data_in )
3'b000 : data_out = 8'b0000000;
3'b001 : data_out = 8'b0000001;
3'b011 : data_out = 8'b0000010;
3'b010 : data_out = 8'b0000100;
3'b110 : data_out = 8'b0001000;
3'b111 : data_out = 8'b0010000;
3'b101 : data_out = 8'b0100000;
3'b100 : data_out = 8'b1000000;
default : data_out = {8{1'b0}};
endcase
end
end
endmodule

格雷码仿真时序图

总结：从以上可以看到格雷码译码会消除毛刺，通过实验发现仿真时与芯片型号，仿真时间长短几乎看不出有什么影响

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