原创 verilog实现串口

2015-4-9 11:29 670 4 4 分类: FPGA/CPLD 文集: FPGA&verilog

主要记录自己在利用verilog实现串口的时候一些简单的介绍和遇到问题和思考。备忘

 

1、串口传输格式,可以百度,有很多也很简单。串口分为两部分,一个收,一个发。所以在verilog实现时可以把这两部分分开。也就是两个fifo配套收和发的.v文件,可以实现一个串口。一般人实现串口的都是这么想的吧。下面是文件的层级结构:

 

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