原创 VGA接口扫盲篇

2008-8-5 20:13 9826 12 15 分类: 通信

VGA接口扫盲篇<?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" />


     题记:这几天一直在折腾VGA接口,用FPGA驱动液晶显示器,目前只是停留在简单的颜色变化显示层面,在更深入的驱动液晶显示器显示出文字甚至图形图像前,扫下盲先。


VGA显像原理


显示器通过光栅扫描的方式,电子束在显示屏幕上有规律地从左到右、从上到下扫描。在扫描过程中,受行同步信号控制,逐点往右扫,完成一行扫描的时间倒数为行频;同时又在行同步脉冲期内回到屏幕的左端,从上往下形成一帧,在垂直方向上受场同步信号控制,完成一帧的时间倒数为场频。图像的显示过程即为在电子束扫描过程中,将地址与图像的像素依次对应,每一个被寻址的像素只获得其自身的控制信息,而与周围的像素不发生干扰,从而可以显示稳定的图像。


VGA接口是显示卡上输出模拟信号的接口,也叫D-Sub接口。这种接口上面共有15个针孔,分成3排,每排5个,通过模拟VGA接口显示图像的工作原理,将计算机内部以数字方式生成的显示图像信息,通过显卡中的ADC转变为RGB三基色信号和行、场同步信号, 通过电缆传输到显示设备中。


 


VGA接口定义



管脚


定义


1


红基色 red


2


绿基色 green


3


蓝基色 blue


4


地址码 ID Bit


5


自测试 ( 各家定义不同 )


6


红地


7


绿地


8


蓝地


9


保留 ( 各家定义不同 )


10


数字地


11


地址码


12


地址码


13


行同步


14


场同步


15


地址码 ( 各家定义不同 )


管脚对应的VGA接口如下:


<?xml:namespace prefix = v ns = "urn:schemas-microsoft-com:vml" />


3dcc2253-69a4-4df9-a388-49af57b95fd3.jpg 


VGA时序


VGA的时序包括水平时序和垂直时序,且两者都包含的时序参数有:水平(垂直)同步脉冲、水平(垂直)同步脉冲结束到有效显示数据区开始之间的宽度(后沿)、有效显示区宽度、有效数据显示区结束到水平(垂直)同步脉冲宽度开始之间的宽度(前沿)。水平有效显示区宽度与垂直有效显示区宽度逻辑与的区域为可视区域,其他区域为消隐区。


 


 

文章评论3条评论)

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用户440820 2014-12-1 19:24

说的好

用户213742 2012-6-5 20:08

一直不明白一个问题,VGA怎么判断可视区域的呢?我们知道一共只有5个信号,RGB和HS、VS,并没有像数字接口那样提供一个Data Enable信号来指示真正的图像数据。如果是靠数据本身来产生的,那么全黑图像怎么办?恳请解答!

用户943186 2010-10-21 17:23

现在主流的VGA接口,支持即插即用,其12、15脚是DDC通道,类似于IIC总线的SDA和SCL了,可以双向通讯;而9脚是+5V供电,由PC机显卡送过来5V供电,给显示器驱动板的24C02等存储EDID数据的芯片供电。真正用来显示图像的,只要6根线足矣,1/2/3/,三基色;5/6/7/8一起接地;13/14,行场同步信号。

ilove314_323192455 2010-10-15 17:25

需不需要FIFO要看你的数据流形式,如果数据频率较大超过外部双口RAM的读写频率,那么FIFO是需要的,开多大也是根据他们直接的频率差别来考虑。没有觉得的答案,根据系统需要考虑

用户1409300 2010-10-15 12:39

你好,想请教一个问题,就是我AD转换的数据要存到外部双口RAM中,一定要经过一个内部FIFO缓存才可以存到外部RAM吗,不可以直接就存吗?另外,我那外部RAM范围是256KB,那么在设计一个FIFO时要求的FIFO空间是多少呢,有那些要求呢?还有如果我想把外部RAM的数据通过PCI接口转上PC机,数据也必须经过一个FIFO吗?谢谢!!!! 另外,有没有一些相关的资料可以推荐我看看的呢,有的话可以发到我邮箱吗,谢谢!!! xixizhouxixi@163.com

ilove314_323192455 2010-10-15 08:13

浮点数的存储本质上和整型数是一样的,你只要把他们放大缩小看就行了

用户142112 2010-10-14 23:04

一般项目里会把可能用到的RAM,FIFO或者ROM之类的预先定义好,放在库里,而且定义好的存储器的名字后会加上后缀BRAM或是DRAM,来表示是块存储器或者是分布式的存储器,这样在使用的时候,各个模块使用多少,使用那种类型的存储器会有一个分配,利于掌握资源的分配。

用户1083553 2010-10-14 15:05

特权兄,你好!向你请教一个问题,我在用simulink做DSP模型仿真时用到其中的乘法器,假如我指定乘法器的输入为fixed point signed类型,字长16bit,小数部分为14bit,这样MSB为符号位,次高位为整数位,本来两个16位的数相乘最多需要32bit来表示,但是我可能用不到那么高的精度,而且也为了考虑节省资源,我将输出格式设置为Fixed Point signed类型,字长17bit,小数部分仍然为14bit,MSB为符号位,接下来的两位用作整数位。我的问题是:在用FPGA实现这个乘法器的时候,如何去截取乘法器输出位呢?
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