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       这两天正在用chs的captial logic来绘制系统电气原理图，感觉功能很强大，在此稍微做个介绍。      Capital Logic 是电气系统的逻辑设计工具，它提供一个图形化、集成化的电气设计环境，可以完成原理图、接线图的设计。内嵌 Capital Manager 模块，提供全面的管理功能，包括项目管理、用户管理、元器件库管理以及文档报表输出等功能。 主要特性包括 : 用户角色和权限定义； 项目配置管理； 设计版本及有效性管理； 全面的元器件定义和管理； 方便的屏蔽端定义； 支持共享设计对象； 自动插入splice； 支持Symbol库； 自动执行DRC（设计规则检查）； 用户报告内容定制； 基本逻辑和直流仿真；