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  • 热度 1
    2013-4-12 23:29
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    实验中通过Zynq7000 PL采集ADC数据,处理后经PS HP0 - DDR3 Controller 存储至DDR3,解决方案有两种: 方案一:PL端采集ADC的数据直接经PS HP0 - DDR3 Controller 存储至DDR3,但是测试的时候发现数据读写都有问题。为了验证此问题,做如下测试: 首先确保PS读写通道工作正常,再通过PL写,PS读,读回来的数据不对,说明PL写操作可能有问题;最后通过PS写,PL读,读回来的数据也有问题(地址跟数据不对应),分析其原因可能是AXI 互连机制仲裁的问题。因为PL和PS同时访问DDR3,AXI总线上有两个Master,这就需要一个AXI仲裁器,但是PL端设计没有仲裁功能【参阅P034 DDR3数据交换解决方案】。 (PS端是否有仲裁机制,需进一步了解)。 方案二:根据方案一遇到的问题,考虑在PL端加一个DMA,图示为在ZedBoard板上测试DDR3数据交换设计方案,经测试数据交换正确。 如果总线生存在多个Master,就需要仲裁器来决定如何控制各种主模块对总线的访问,对Zynq而言,每个AXI互连机制是采用两级仲裁方案来解决访问冲突的。        
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    AXIABPAHB的AMBA规范资源大小:1.82MB[摘要]本序言介绍了AMBAAXI和ACE协议规范。它包括下列各节;关于这个规格在x页在第11页使用此规范第十三页的惯例补充阅读第十五页关于第十六页的反馈
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    SoC设计必知的AMBA协议之AXI……
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    赛灵思中国通讯赛灵思第四十一期2011年秋季刊中国通讯XilinxNewsISSUE41AUTUMN2011封面专题手把手课堂:FPGA101利用可编程振荡器增强FPGA应用赛灵思如何让FPGA设计存档,轻松实现更新7系列FPGA的功耗减半示例应用指南技术长廊……
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    时间: 2019-6-2 11:21
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    上传者: royalark_912907664
    针对多FPGA芯片验证系统中FPGA端口资源有限的问题,提出了一种基于AXI总线协议的多FPGA片间总线传输方法。首先将所需传输的数据整合到AXI总线上,然后采用高速串行总线对数据进行传输,最后搭建FPGA的原型验证平台,通过vivado软件对传输数据进行分析,实现了多片FPGA间数据的高速传输。该方法不仅克服了FPGA原型验证系统中I/O端口有限的瓶颈,而且可支持任何厂家的FPGA片间传输,具有很强的工程实践性。
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