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煞笔

我所说的非法就是你所谓的“要求”本身就有可能非法。至于LE的工作模式，我这篇博文应该有详细的描述。说白了，如果只有combout输出，那肯定是normal模式，如果有sumout输出，那肯定是算是模式

你说的值非法是什么意思？是说这个掩码有个范围，超过这个范围就不起作用了吗？？？我在chip planner里面也改过这个掩码，但是好像每次都不按我的要求来？？ 另外还有一个问题，LE的两种工作模式怎么设定啊？？是编译器自动按照功能来设置吗？

你说的值非法是什么意思？是说这个掩码有个范围，超过这个范围就不起作用了吗？？？我在chip planner里面也改过这个掩码，但是好像每次都不按我的要求来？？ 另外还有一个问题，LE的两种工作模式怎么设定啊？？是编译器自动按照功能来设置吗？

你所谓的设置的掩码是在例化原语的时候设置的吗？如果在chipplanner里看到的值和你设置的不一样，有可能是设置的值非法，你可以试着在chipplanner里修改到你当初设置的值，看是否可行？

怎么提交的代码格式消失了啊？？？？

楼主，能否请教个问题。我之前在使用这个原语（CycloneIII,QuartusII10.1）时遇到一个问题，现在还没有弄明白原因。当我设置了lut_mask后使用chip planner观察到的lut的值和设置的不同。比如： module Cycloneiii_lcell_comb_test(in,out,result); input[3:0] in; output out; output[1:0] result; wire cout;/*synthesis keep*/ cycloneiii_lcell_comb w1( .dataa(in[0]), .datab(in[1]), .datac(in[2]), .datad(in[3]), .combout(result[0]) ); defparam w1.lut_mask = 16'hf588; defparam w1.sum_lutc_input = "datac"; defparam w1.lpm_type = "cycloneiii_lcell_comb"; defparam w1.dont_touch = "off"; endmodule 你有没有试过这样做？或者说，我这里哪个地方出错了，能否指点下？

我知道这个功能，也一直在用，呵呵。我的意思是不知道什么原因导入的时候老是统计我的字数超标。一般这种超标根据我的经验：1.是图片；2.是表格；3.代码等。感觉EDN博客统计字数是根据占用的行数来统计吧。

在IE浏览器下可以使用高级编辑直接导入word文档呀，你是什么浏览器？

版面好差哦，无法使用高级功能直接导入word文档，只能打开word进行一段一段的复制粘贴工作，体力活啊。一不小心就超字数了^0^.看来要分两次了，说明一下，这里最后一张表格就是本人前面在开篇里提到的解决我一直以来在FPGA tdc设计中的疑惑，即逻辑单元（或者更高层的LAB）的端口具有可编程取反硬件结构，programable inversion。这个结构的作用在Stratix/Cyclone的EDA工具开发指导里有一些介绍。当然如果我们要对设计进行ECO修改，了解这个东东对我们理解综合工具以及fitter如何处置我们的逻辑设计非常有帮助。如果不能对底层布局布线有很好地理解，何谈ECO手动修改。