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fuxiao123_401762695 2010-4-11 18:31
- modelsim用不了原来有这问题
- 装了modelsim之后每次运行都是license，试了各种方法都不行。后来才发现，竟然是modelsim和solidworks冲突，把solidworks的东西删除干净就好了。 ...
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- 终于会在quartus里面使用synplify pro进行综合了
- 需要这么设置一下
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- 硬件设计之鸡毛蒜皮
- 鸡毛蒜皮之一：成本节约 现象一：这些拉高/拉低的电阻用多大的阻值关系不大，就选个整数5K吧 点评：市场上不存在5K的阻值，最接近的是4.99K（ ...
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- 同步和异步
- 同步逻辑和异步逻辑之间的区别：同步逻辑是时钟之间有固定的因果关系，异步逻辑是时钟之间没有固定的因果关系。异步电路主要是组合逻辑电路，用于产生地址译码 ...
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- ISE文件类型说明
- 在使用ISE进行设计的过程中，会在你的工程目录中生成好多类型的文件，这些文件是什么文件呢？通过自己和网上朋友的经验对ISE的文件类型做一下小小总结： ...
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- 如何测试程序在DSP上的运行时间？
- 如何测试程序在DSP上的运行时间？ 1、用CLOCK（）准确吗？ 2、用CCS上的工具，但如何使用？ 在你要测试时间的程序的两端，用Project Toolbar上的Toggl ...
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- 由丰田召回说起
- 丰田大规模召回是汽车业内的一件大事，丰田一直以加速踏板受地垫阻碍不能返弹为由解释事故原因。这个理由受到质疑，这就有使问题进一步扩展的可能。据 201 ...
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- 什么是综述？怎样写好综述？综述的写作步骤是什么？综述论文如何审稿？综述写作方法有哪些？
- 什么是综述？怎样写好综述？综述的写作步骤是什么？综述论文如何审稿？综述写作方法有哪些？?xml:namespace prefix = o ns = "urn:schemas-microsoft-com ...
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- 你是植物大战僵尸里的谁呢？
- 测试网站 http://edu.sina.com.cn/gaokao/2010-01-05/1357232298.shtml 我的是 撑杆僵尸 （僵僵在撑杆跳！） 撑杆僵尸总是能够独辟蹊径， ...
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- 与时间赛跑 高效制胜
- 你是否常常听到这样的话 “计划赶不上变化，变化赶不上老板一通电话”， “我总被事情拖着走，没有时间完成我的梦想”, “我这一年忙疯了”。 又或你的生活中 ...
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- 与时间赛跑 高效制胜
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- 为中国工程师简化FPGA设计已成离弦之箭
- 不像欧美等地区 40% 的 IC 设计工程师具备 FPGA 设计的知识和经验，中国的设计工程师只有约 10% 的工程师具备相关知识和经验。主要原因除了 FPGA ...
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- 各类有个性工程师的爆笑简称
- 脚最多的工程师姓吴，叫吴工（蜈蚣）； 脸最黑的工程师姓包，叫包工（包公）； 脸最红的工程师姓关，叫关工（关公）； 身份最卑微的工程师姓明，叫 ...
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- 关于Verilog HDL的学习
- 1. 首先讲一下为什么需要学习硬件描述语言（Hardware Description Language，HDL） 硬件描述语言是一种形式化方法描述数字电路和系统的语言 ...
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