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huotingtu_505472073
2010-11-19 18:05
【转】ISE 详细步骤、作用及其理解
p/*信号定义: clk: 时钟信号,本例中其频率值为1Hz; decide: 电话局反馈回来的信号,代表话务种类,“01”表示市话,“10”表示 长话,“11” ...
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2010-11-19 18:05
【转】Verilog电话计费器的代码
/*信号定义: clk: 时钟信号,本例中其频率值为1Hz; decide: 电话局反馈回来的信号,代表话务种类,“01”表示市话,“10”表示 长话,“11”表 ...
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huotingtu_505472073
2010-11-19 18:04
【转】SystemVerilog语言简介2
15. 强制类型转换 Verilog不能将一个值强制转换成不同的数据类型。SystemVerilog通过使用type’操作符提供了数据类型的强制转换功能。这种强制转换 ...
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huotingtu_505472073
2010-11-19 18:03
【转】SystemVerilog语言简介
SystemVerilog是一种硬件描述和验证语言(HDVL),它基于IEEE 1364-2001 Verilog硬件描述语言(HDL),并对其进行了扩展,包括扩充了C语言数据类型、结构、压 ...
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2010-11-19 18:03
【转】在Nexar上实现一个完整的嵌入式系统
以下我们将结合一个实例来简要介绍一下如何在Nexar上实现一个完整的嵌入式系统设计过程。 首先:创建一个新的FPGA工程 1、选择菜单 FileNewFPGA Pro ...
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2010-11-19 18:02
【转】让ISE8.1和ISE8.2的库共存于ModelSim6.0
(包含SmartModel) 第一次compxlib - ISE8.1 1. 设置好XILINX环境变量:XILINX=D:ISE81 2. 设置好LMC_HOME环境变量: LMC_HOME=D:XilinxLibmti_pesmartmodel8 ...
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【转】SystemC安装及设计流程2
3. Compile design and watch wave 3.1. For Linux 3.1.1. Create Makefile 要在Linux环境下编译SystemC的工程,需要编写Makefile。假设我们已经建立 ...
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huotingtu_505472073
2010-11-19 18:01
【转】SystemC安装及设计流程1
1. SystemC Setup 从 www.systemc.org 下载最新的SystemC library,这里我们统一使用已经stable的2.1.v1版。在library下载到本地以后,需要进行一次性 ...
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2010-11-19 18:00
【转】SystemC 2.1在Visual Studio 2005下使用
SystemC 2.1目前能在Visual Studio .NET 2003的环境下开发,移植到Visual Studio 2005之后会出现一些小问题。经研究,我们需要改动一些参数。 步骤一:编译S ...
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2010-11-19 17:59
【转】全数字锁相环的verilog源代码
仿真已通过 module dpll(reset,clk,signal_in,signal_out,syn); parameter para_K=4; parameter para_N=16; input reset; input clk; input signal_in; output ...
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2010-11-19 17:59
【转】Libero 软件的使用
第1章 License 设置 大家好!今天由我来给大家介绍一下Libero 软件的快速入门。 Libero 软件是Actel FPGA 的开发环境,它支持Actel 公司所有的 ...
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2010-11-19 17:58
【转】EDA仿真
1、 仿真的目的 : 在软件环境下,验证电路的行为和设想中的是否一致。 2、 仿真的分类 : a) 功能仿真:在RTL层进行的仿真,其特点是不考虑构成电路的 ...
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2010-11-19 17:57
【转】基于Modelsim FLI接口的协同仿真
1 前言 协同仿真就是利用仿真工具提供的外部接口,用其它程序设计语言(非HDL语言,如c语言等)编程,用辅助仿真工具进行仿真。Modelsim提供了与c语言的 ...
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2010-11-19 17:56
【转】基于MATLAB 的DSP 调试方法
MATLAB 具有强大的分析、计算和可视化功能,利用MATLAB 提供的数十个专业工具箱,可以方便、灵活地实现对自动控制、信号处理、通信系统等的算法分析和仿真,是算 ...
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【转】如何搭建Xilinx FPGA开发环境
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