W5500-EVB 用户手册 V1.0
1、简介
W5500 Evaluation Board 简称W5500-EVB,是为了方便广大用户更好的了解、使用W5500这款网络芯片所开发的评估板。该板采用了STM32F103RCT6+W5500的设计,基于ARM的Cortex-M3平台。
W5500延续了之前WIZnet系列产品的ToE技术,使用硬件逻辑门电路实现TCP/IP协议栈的传输层及网络层(如:TCP, UDP, ICMP, IPv4, ARP, IGMP, PPPoE等协议),并集成了数据链路层,物理层,以及32K字节片上RAM作为数据收发缓存。从而把网络数据流量的处理工作全部转移到W5500集成硬件中进行。使得上位机主控芯片(此板为STM32F103RCT6),只需承担TCP/IP应用层控制信息的处理任务。从而大大节省了上位机对于数据复制、协议处理和中断处理等方面的工作量,提升了系统利用率及可靠性。
在操作过程中,用户可以近似的将W5500作为STM32F103RCT6的一个外设RAM来使用,非常简易。另外,W5500还提供网络唤醒及掉电模式供客户选用,从而降低系统能耗。W5500对外接口为通用的80MHz高速SPI,供不同平台拓展高速以太网方案选用。
2、特点
- 支持硬件TCP/IP协议:TCP, UDP, ICMP, IPv4, ARP, IGMP, PPPoE
- 支持8个独立端口(Socket)同时通讯
- 支持掉电模式
- 支持网络唤醒
- 支持高速串行外设接口(SPI模式0,3)
- 内部32K字节收发缓存
- 内嵌10BaseT/100BaseTX 以太网物理层(PHY)
- 支持自动协商(10/100-Based全双工/半双工)
- 不支持IP分片
- 3.3V工作电压,I/O信号口5V耐压;
- LED状态显示(全双工/半双工,网络连接,网络速度,活动状态)
- 48引脚LQFP无铅封装(7x7mm, 0.5mm 间距)
3、规格
表格 1 规格
模块 |
器件 |
描述 |
备注 |
核心板 |
以太网核心芯片 |
W5500 |
全硬件TCP/IP协议栈 |
MCU |
STM32F103RCT6 |
|
|
EEPROM |
AT24C16 |
4K电可擦除只读存储器 |
|
J1,J2排针 |
外接引脚 |
2.54mm 12*2 |
|
接口板 |
网络变压器 |
|
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RJ-45 |
LM1117-3.3 |
不带变压器及灯 |
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电压转换芯片 |
FT232RL |
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USB转RS232芯片 |
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LED指示灯 |
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Link,ACT,Speed |
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J3,J4排针 |
外接引脚 |
2.54mm 12*2 |
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P3排针 |
J-Tag接口 |
2.54mm 12*2 |
|
|
按键 |
直插上位按键 |
6个 |
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