原创 fifo宏模块验证

2009-10-27 22:45 1564 6 7 分类: FPGA/CPLD

实现fifo的同时读写,保证写始终有效,数据宽度保持和触发时钟周期一致,这样时钟上升沿就能保证在数据有效时间内


 


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仿真结果:


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保证写始终有效

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文章评论1条评论)

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用户349741 2011-5-22 19:45

你好,我刚刚接触FIFO,有些问题想请教你,可不可以告诉我你qq号?
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