原创 波形产生及数模混合电路分析

波形产生及数模混合电路分析<?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" />

1、下图所示的数据串——并转换电路由移位寄存器、计数器、锁存器构成。为了实现8位数据的串并转换，使用8个D触发器。输入串行数据D：0101001110101100，每8位数据转换为1组，每1位数据的脉宽为1us，延迟0s；CLR是清零信号，有效脉宽为0.5us，延迟0s；时钟信号CLK为占空比为0.5的1MEGHz周期信号，初始值为0，延迟时间0.2us。

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8位数据的串并转换电路

D、CLR、CLK、R、D[0：7]、Q0-Q7的波形图

工作原理：首先是CLR清零，CLK延迟0.2us后计时，输入数据D，每个周期输入1位，并且数据向前移一位。8个周期后，前面8位数据01010011分别存入D0——D7中，此时74LS<?xml:namespace prefix = st1 ns = "urn:schemas-microsoft-com:office:smarttags" />161A产生一个脉冲信号，使8位数据通过74LS374转换为并行数据。然后继续输入8位数据到D0——D7中，8个周期后74 LS161A产生触发信号，使8位数据通过74LS374转换为并行数据。

2、下图所示是一多路时钟信号产生电路。给出输出波形并分析。

多路时钟信号产生电路

Sttl、S、F1、F2波形图

74LS161为二进制计数器    74HC74为D触发器

由上图产生时钟信号。

下图为CLK、STTL、U1：RCO、U2：RCO、U3：RCO波形图。

开始的时候，STTL、U1：RCO、U2：RCO、U3：RCO分别为0、1、1、1，由于STTL接3个计数器的置位端，第一个时钟脉冲到来时，预置数被加载到输出端。第二个时钟脉冲到来时，3个计数器开始记数。一个脉冲后U1：RCO输出为1，U2加1，U2：RCO输出为0，U3：RCO输出为0，STTL为1。后根据74LS161为二进制计数器的参数，U1每个周期进行加1，16个周期后U1：RCO再输出为1，而U2 、U3在这期间一直保持原有数据。U1：RCO输出为1后，U2 、U3先后输出一个高电平，STTL变为低。然后重复预置数，再进行前16个周期的动作。相当于STTL作为计数器的预置数使能信号。

根据74HC74数据手册，STTL作为U4A的置位使能信号，U5A、U6A的清零信号，STTL为低的时候F1输出为高，F2为低，S为高。STTL为高的时候，STTL作为清零信号不起作用，根据D触发器的规则进行变换 。当STTL再为低的时候，重复前面的波形。相当于F1、F2波形相反，U5A的反向端作为U6A的置位使能信号。