2008年制作，前端用通信器件ECL高速分频器加74LS数字逻辑IC打造，直通闸门式的，较精准但反应速度比较慢。基准时钟是用的温补有源晶振。
最高计数频率决定于一级ECL的带宽，分频倍率，理论上第二级4017预分频输入最高40MHz，乘以前级的64倍频；但鉴于是洞洞板焊着玩的，10M以上没测试过。
6位40110驱动的7段数码管直显。可显示999MHz
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