原创 《基于FPGA的快速系统原型开发》CH3.1译

2009-9-13 22:36 5325 9 11 分类: FPGA/CPLD

《基于FPGA的快速系统原型开发》CH3.1译


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3.1 概述<?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" />


         与其它工程学科一样,绝大多数成功的FPGA设计团队都遵循着一套固有的设计流程。对于大多数的工程项目,开发流程中每个设计阶段的顺序及其相互间的关系都是固定的。高层次FPGA设计流程包括了从设计需求的定义到最终产品的量产所必须经历的各个阶段。图3.1给出了高层次FPGA设计的流程图。


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3.1 FPGA设计流程


         为了快速有效的完成系统开发,采用并遵循优化的设计流程是绝对必要的。这种优化的设计流程有利于设计团队处于一种尽可能高效率的开发环境中,将更多的时间和精力投入到设计本身的实现上来。该设计流程需要设计者在适当的时候进行设计检查,并明确设计的关键阶段、每个阶段的主要目标和预期成果。优化的设计流程也应突出关键的设计决策,也鼓励设计参与者为做出这些决策而努力。


         FPGA设计流程所固有的重复性,几乎是FPGA设计流程的各个阶段都不可避免的。许多设计决策如FPGA器件的选型、设计语言和开发工具的选择以及设计层次的划分,都将在很大程度上影响随后的设计。任何设计过程中带来的开发时间上的延长都有可能是成倍的,因为受影响的设计阶段很可能处在一个设计周期的迭代阶段。FPGA设计的每个阶段需要重复的次数很大程度上取决于设计规范性、复杂性、项目规模、开发工具、设计团队的经验和设计的稳定性要求。


         快速开发的目标是缩短设计周期——从定义系统需求到编写产品功能说明。为了达到此目标,限制或减少通常基于FPGA的开发流程所固有的重复性是最明智的选择。


 

 

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文章评论2条评论)

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用户1748817 2016-4-20 17:17

老牛了!!!

用户377235 2015-8-24 18:38

pin2reg 改成 pin to reg reg2reg 改成 reg to reg reg2pin 改成 reg to pin

 

谢谢特权同学的分析,目前对时序约束只是大致了解,还没有深刻的体会,不过我会加油的

用户447325 2015-3-12 14:21

学习一下

用户1677779 2014-4-15 15:48

多谢特权老兄的这篇博文。解答了我心中对于setup relationship 和 hold relationship概念的理解。之前我当时消化了setup relationship 但是 对于后者一直消化不了。 现在看过仔细想过后,发现就是对于前后寄存器的一个时钟周期差理想延时的理解,非常棒 ,这个模型相当适用。 我也想了想,如果前后寄存器我们不按照需要一个周期延迟来,那么我们的时序分析如何进展开来呢? 当然,实际客观一前一后的寄存器肯定是有延时,的的确确是非常好的一个分析方法

用户374509 2014-3-4 21:24

Hi,是基督徒吗?

用户377235 2013-7-27 15:34

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reg2reg 改成 reg to reg

reg2pin 改成 reg to pin

这样好点吧

用户1584993 2009-9-14 10:16

航航哥的新工作开始了吗?翻译

用户188034 2009-9-13 22:45

只有一部分翻译?
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