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用户1395232 2010-1-26 19:59: CycloneIII_GCLK_PLL阅读笔记; 前段时间项目中使用了CycloneIII这款芯片，负责了时钟方面的设计，摘录时钟网络和PLL使用笔记： 1、芯片管脚上可以输入 16 个单端时钟或者 8 ...; 5464 13 1 14

用户1395232 2009-3-7 12:16: 感悟--从单片机到PGA; 翻开两年前在学校做项目后提交的心得体会，看着这些熟悉而又生涩的文字，感慨万千。 ===================================================== ...; 4129 9 2 11

用户1395232 2009-2-23 20:11: 关于上拉电阻(ZT&YC); 最近涉及到了上、下拉电阻的使用，搜索到不少资料。自己总结了两大方向： ================================================================================= ...; 3778 9 0 9

用户1395232 2009-2-21 14:59: 异步FIFO的设计; 异步 FIFO 的设计是一个老生常谈的问题了，网上有很多很经典的教程和论文。此处以 Clifford E. Cummings 的文章 'Simulati ...; 3886 8 0 8

用户1395232 2009-2-20 16:07: 逻辑设计学习之读后感; 几个月前从网上看到了王x人写的《浅淡逻辑设计的学习》，这个人应该是个专家吧。当时看完了4页的文字倒没什么收获，几个月后再把它翻出来看--完全不一样的感觉。 ...; 3918 12 5 17

用户1395232 2009-2-11 09:12: set_input_delay/ set_output_delay之图解; 在edn上看到很多仁兄的文章大受启发也写写自己的理解一同讨论 set_input_delay/ set_output_delay ...; 10292 15 1 16

用户1395232 2009-2-10 20:30: set_input_delay/ set_output_delay之图解; 在edn上看到很多仁兄的文章大受启发也写写自己的理解一同讨论 set_input_delay/ set_output_delay 在与时钟选项定义的时钟相关的输入 port ...; 9285 7 0 7

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