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huotingtu_505472073
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可以写一写技巧的东西,可能需要的人更多
curton
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2024-12-3
怎么才能做到,休息时间还能持续学习? ...
我还是比较支持技术人员当大领导的
curton
评论博文
2024-12-3
谈谈我从“技术”到“职能管理”再回到“技 ...
点赞,你的思考就是大家的思考。
curton
评论博文
2024-12-3
翻译了一篇文章,看看我们将如何应对人口下 ...
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huotingtu_505472073
2010-12-20 23:20
【转】NFC在手机中的使用急剧增加,预示移动支付革命即将开始
作者,JAGDISH REBELLO博士 据iSuppli公司,在无线巨头诺基亚和谷歌等的支持下,预计近距离通信(NFC)技术在手机中的应用从明年开始将急剧增长,从而为移 ...
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huotingtu_505472073
2010-12-20 13:13
【转】第七章 Keil C51的代码效率(转帖)
C51程序编译生成汇编代码的效率,是由许多因素共同决定的,对于Keil C51,主要受以下两种因素影响: 第一节 存储模式的影响 存储模式决定了缺省 ...
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huotingtu_505472073
2010-12-20 13:11
【转】第五章 Keil C51库函数参考(转帖)
C51强大功能及其高效率的重要体现之一在于其丰富的可直接调用的库函数,多使用库函数使程序代码简单,结构清晰,易于调试和维护,下面介绍C51的库函数系统。 ...
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huotingtu_505472073
2010-12-20 13:10
【转】第四章 Keil C51高级编程(转帖)
本章讨论以下内容: l 绝对地址访问 l C与汇编的接口 l C51软件包中的通用文件 l 段名转换 ...
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2010-12-20 13:08
【转】Keil C51编译错误总结(转帖)
Keil C51编译错误总结 ≮孤☆星≯笔记 1.第一种错误信息 ***WARNING L15: MULTIPLE CALL TO SEGMENT SEGMENT: ?PR?_WRITE_GMVLX1_REG?D_GM ...
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2010-12-10 21:37
【转】C51指针类型和存储区的关系详解
指针类型和存储区的关系详解 一、存储类型与存储区关系 data --- 可寻址片内ram bdata --- 可位寻址的片内ram idata --- 可寻址片内ram,允许访问全 ...
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huotingtu_505472073
2010-12-9 08:04
extern用法详解(转)
1 基本解释 extern可以置于变量或者 函数 前,以标示变量或者 函数 的定义在别的文件中,提示编译器遇到此变量和 函数 时在其他模块中寻找其定 ...
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huotingtu_505472073
2010-11-26 13:04
【转】VHDL设计中电路简化问题的探讨
近年来,随着集成电路技术的发展,用传统的方法进行芯片或系统设计已不能满足要求,迫切需要提高设计效率。在这样的技术背景下,能大大降低设计难度的VHDL设计方 ...
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huotingtu_505472073
2010-11-26 13:04
【转】在PLD开发中提高VHDL的综合质量
引 言 随着计算机与微电子技术的发展,电子设计自动化EDA(Electronic Design Automation)和可编程逻辑器件PLD(Programmable Logic Device)的发展都非 ...
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2010-11-26 13:03
【转】VHDL设计的消抖与滤波
在同一块电路板上,由于信号线的走线过长而产生的高频毛刺我们可以通过在接近输入端串联一个100欧左右的电阻来滤除。但是对于板外信号,或者板内其他干扰造成较 ...
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huotingtu_505472073
2010-11-26 13:02
【转】分频器的VHDL描述
在数字电路中,常需要对较高频率的时钟进行分频操作,得到较低频率的时钟信号。我们知道,在硬件电路设计中时钟信号时非常重要的。 下面我们介绍分频器的 ...
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huotingtu_505472073
2010-11-26 13:02
【转】VHDL秒表计时器
本秒表计时器用于体育竞赛及各种要求有较精确时的各领域。此计时器是用一块专用的芯片,用VHDL语言描述的。它除开关、时钟和显示功能以外,它还包括1/100s计 ...
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2010-11-26 13:01
【转】在测控系统中用IP核实现D/A转换
摘要:采用数字化技术、在测控系统中用IP核实现D/A转换,并且在1片可编程逻辑器件中实现。它不受温度的影响,既可保持高分辨率,又可降低对电路精度和稳定度的要 ...
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huotingtu_505472073
2010-11-26 13:00
【转】n.5分频的VHDL实现
这种分频需要对输入时钟进行操作。基本的设计思想:对于进行n+0.5分频,首先进行模n的计数,在计数到n-1时,输出时钟赋为‘1’,回到计数0时,又赋为0,因此, ...
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2010-11-26 12:58
【转】数字信号发送和接收的VHDL源码
【数字信号的发送和接收】:设计一个5位数字信号的发送和接收电路,把并行码变为串行码或把串行码变为并行码,串行偶校验检测器可通过异或实现。在数据接收端, ...
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