用户1600457的文章-第2页-面包板社区

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用户1600457 2011-8-3 20:10: fir低通滤波器的编写（串行）; 这几天编写了一个FIR低通滤波器，也算一波三折啊。主要是对FPGA内部的数据运算不熟，在FPGA中是没有负数的说法的，确切的说应该是硬件没有负数的概念，FPGA是硬 ...; 2201 24 1 25

用户1600457 2011-7-31 10:33: 原码补码反码的深入学习（转）; 本篇文章讲解了计算机的原码, 反码和补码. 并且进行了深入探求了为何要使用反码和补码, 以及更进一步的论证了为何可以用反码, 补码的加法计算原码的减法. 论证 ...; 2066 13 1 14

用户1600457 2011-7-30 09:57: testbench 中仿真时间单位需注意; 最近在仿真时候，总是遇到没有数据的情况。根据以往经验，编写的程序应该是没有什么问题的，因为在很简单的计数都无法获得正常数据。翻开其他正常的工程中我发 ...; 3064 15 0 15

用户1600457 2011-7-26 21:28: 求助 cyclone iii 在modelsim中仿真RAM 无法实现; 最近在用cyclone iii 的器件编写有关通信模块。我在调用RAM的时候在modelsim中根本无法启动，也就是RAM的时钟都没有。不知道是什么原因。我在modelsim中添加的 ...; 3406 13 2 15

用户1600457 2011-7-26 20:26: DDS的编写(verilog); 先说说DDS算法的基本原理： DDS是直接式数字频率合成的简称。它在无线通信系统实现中是一门关键技术。其实，DDS在FPGA 中的实现方法说白了就是在定义好的R ...; 6326 15 5 20

用户1600457 2011-7-26 20:19: modelsim仿真时候input数据在testbench中编写的注意点; 这两天翻出前几天编写的DDS的程序，重新改了点，把输出信号选择给去掉了，只留下原来的输出正弦波以及余弦波信号。但是，在modelsim中重新仿真的时候却死活 ...; 3813 14 0 14

用户1600457 2011-7-26 09:25: 终于把交织器调试好了; 哎，第六天了，终于把交织器给调试好了。还是多亏了学长的帮忙啊。有时候，学技术有人提点真是一种万幸啊。一个人在一种思维中打转往往会出不来，这时候要是有 ...; 1280 12 0 12

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