原创 求助 cyclone iii 在modelsim中仿真RAM 无法实现

2011-7-26 21:28 3270 8 10 分类: FPGA/CPLD
最近在用cyclone iii 的器件编写有关通信模块。我在调用RAM的时候在modelsim中根本无法启动,也就是RAM的时钟都没有。不知道是什么原因。
我在modelsim中添加的文件有以下几个:220model , altera_primitive , .vo文件 , .vt文件 , cyclone iii的器件库文件 , altera_mf 。
20110726212804415.png

仿真是可以打开,但是就是没有数据,后来调出RAM的相关信号查看,连时钟都没有,不知是缺少了什么文件导致的?PS:我用同样的程序使用的cyclone ii的器件就可以,没有问题。具体可以看图:
20110726212814125.png
求高手给予解答。小弟多谢!



文章评论2条评论)

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用户591480 2011-11-15 18:17

用verilog仿真的话应该是加库运行的吧,用VHDL的话是加入文件,反正我是这样做的才可以

用户1600457 2011-7-31 10:35

问题已经自己解决,是testbench 中时间单位的错误,需改为1ns ,原本为1ps。这和modelsim中默认的时间单位有关
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