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用户1664174 2011-4-9 03:25: FPGA内部是没有高阻态和不定态信号不是1就是0; 如题：FPGA内部是没有高阻态和不定态信号不是1就是0。这个问题让我吃了很大的苦头，自以为FPGA内部没有被片选中芯片输出高阻很帅，还能节约下一级模块 ...; 6450 9 1 10

用户1664174 2011-4-8 12:55: Verilog阻塞与非阻塞赋值的不同; 越是看似简单、经常接触的。我们越是不知其所以然。这就是我写本文的原因。阻塞和非阻塞赋值一般使用在进程中，包括always和initial进程、as ...; 1979 8 1 9

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