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用户191366
2009-7-22 20:29
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亚稳态相关知识点
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亚稳态是指触发器无法在某个规定时间段内达到一个可确认的状态。当一个触发器进入亚稳态时,既无法预测该单元的输出电平,也无法预测何时输出才能稳定在某个正 ...
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用户191366
2009-6-10 09:38
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未来SoC技术发展的几个特点
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作者:魏少军 时间:2008-11-06 半导体工业的主导已经从过去的面向商务和政府应用转移到面向个人的消费电子意义上来,美国半导体产业协会(SIA)的资料 ...
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用户191366
2009-3-17 10:16
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转--uc/OS 任务调度机制
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一. 内核概述: 多任务系统中,内核负责管理各个任务,或者说为每个任务分配CPU时间,并且负责任务之间的通讯。内核提供的基本服务是任务切换。之所 ...
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用户191366
2009-3-11 09:52
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vim的verilog插件
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2008-11-07 vim下好用的verilog插件:)( 更新) - 版权声明 :转载时请以超链接形式标明文章原始出处和作者信息及 本声明 http://bb2hh.blogb ...
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用户191366
2009-3-6 11:11
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verilog 的one-hot写法
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在critical path上,经常需要使用one-hot的方法实现逻辑。要实现同样的逻辑,可以使用n种coding style,但是要保证工具能正确综合到适合的逻辑,还是要养成良好 ...
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用户191366
2009-3-5 15:07
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用于作为数据信号的clk的处理方法
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某个模块需要把clk信号作为data信号用的时候,例如: c = clk ? a : b ; 直接使用会导致逻辑综合、物理综合的大量时序问题。个人觉得解决方法如下(不对的 ...
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用户191366
2009-3-4 17:06
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MIPS mmu 设置
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对于 MIPS 的 MMU 和 Memory Management, the first and yet important one we need always keep in mind is: No real-mode 没有实模式。这一点是 MIPS ...
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用户191366
2009-3-4 15:23
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ARM存储器的地址映射
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以下基于 S3C4510B 嵌入式系统 S3C4510B 嵌入式系统中,系统复位后存储器的地址空间为 0x000 0000 至 0x3FF FFFF 的范围,其中 ...
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用户191366
2009-3-4 15:20
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MIPS,PowerPC和ARM访问I/O方式的比较
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最近看了一下PowerPC(E500)的MMU部分,看了ioremap的介绍,比较有感触,所以简单比较了一下MIPS,PowerPC和ARM(这里只考虑32位版本的,MIPS64和PowerPC64不 ...
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用户191366
2009-3-2 11:32
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PrimeTime 的基本概念
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一、定义设计环境 在对设计作时序分析之前,必须要定义好设计环境以使得在那些情况下满足 限制条件。 通过以下这些信息来说明设计环境: 时钟:时钟波形和时钟信 ...
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用户191366
2009-2-23 16:28
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EMBED LINUX学习步骤
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嵌入式系统学习步骤(转) 1、Linux 基础 安装Linux操作系统 Linux文件系统 Linux常用命令 Linux启动过程详解 熟悉Linux服务能够独立安装Linux操作系统 ...
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用户191366
2009-2-23 14:57
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异步复位、同步释放
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?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" / FPGA 设计中常见的复位方式即同步复位和异步复 ...
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用户191366
2009-2-23 13:37
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关于GNU LD和LD脚本
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ld,即GNU的连接工具,用于将各目标文件合并在一起,并重新安排他们的数据以及符号的引用,常常是程序编译的最后一步。 ld scripts 即ld脚本。ld 脚本的 ...
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用户191366
2009-2-23 11:57
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IC设计领域及其工种介绍
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模拟与混号讯号电路设计 ?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" / 电路可分为为模拟 IC 与数字 IC 两大 ...
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用户191366
2009-2-23 11:57
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时钟5分频
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用Verilog设计一个5分频器。 5分频,奇数分频都可以类似这么做,只需要改div1和div2的参数。div1为奇数分频除2的余数。采用上升延和下降延分别触发 ...
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