原创 VCS 文件列表

2008-9-11 11:25 4841 4 4 分类: FPGA/CPLD

vcs -f filelist.f,filelist.f是纯的文件列表,也就是说vcs解析的时候,把filelist.f的每一行作为verilog文件去调用,如果filelist.f中有`include/`ifdef等verilog语法,是不对的。


可以这样:filelist.f 中:ss


ss中:(ss中的内容都是verilog文件,每个内容都必须按照verilog的语法写)


define.v


../tmp.f


tmp.f中按照verilog的语法就好了,什么`include/`ifdef都行了

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