原创 Modelsim仿真使用小结

2012-12-18 11:28 1941 18 20 分类: FPGA/CPLD
针对ISE下的Modelsim 仿真可以分为直接在ISE中采用添加库的方式安装Modelsim,例如20121218112458107.jpg

当需要仿真的时候,选中Simulation,而开发的时候选择Implementation。
 
另外一种是采用运行Modelsim然后导入VHDL文件,也就是仿真的实体,再导入testbench文件。
 
最近使用Modelsim仿真,每次在ISE中综合的时候耗费时间比较慢,以下提供一个相对省时的方法。
针对第一种仿真:
当仿真的实体(不是testbench)进行修改之后,然后再次仿真,不需要在ISE中综合,可以直接点击work,找到选择需要重新编译的文件,右击behavioral选择recompile。
20121218112522567.jpg
对testbech的compile在命令行里输入vcom,然后出现对话框
20121218112549252.jpg
PARTNER CONTENT

文章评论2条评论)

登录后参与讨论

用户216637 2012-12-30 10:33

非常感谢你的提示,查阅了一番,发现do脚本确实很好用。

FPGADeveloper 2012-12-28 11:38

这个方法 不是很好哦 最好的使用do脚本
相关推荐阅读
用户216637 2013-02-20 20:56
VHDL语法总结2
  转换函数: conv_std_logic_vector(integer,m+1) 把integer型的数据转换为m+1位的标准矢量值 variable a : int...
用户216637 2013-01-29 21:24
VHDL语法总结1
 容易忽视的问题:generic map(FIFO_width=>8, FIFO_depth=>100)    注意是逗号,不是分号 signal 命名第一个字符不能为数字 1s_...
用户216637 2013-01-04 20:25
关于单片机C语言与VHDL编程的思考
  单片机上C语言的特点: 不需要考虑时钟及电平的变化,只要符合逻辑思维和控制需要  控制程序,更多的时候是条件转移,if 和switch用的很多,但if更多...
用户216637 2012-10-30 22:08
AD9522
参考时钟: 一路差分时钟或者两路单端时钟 支持CMOS,LVPEL,LVDS参考电平,最高频率250MHz 晶体参考时钟16.62M--33.3M ...
用户216637 2012-10-23 21:33
TPS74401
可编程的启动时间延时,通过选择电容来设置启动时间  顺序启动方式,控制Vin,Vbias和Ven达到控制启动顺序的目的,而且在Vin和Vbias上电完成之后再启动Ve...
EE直播间
更多
我要评论
2
18
关闭 站长推荐上一条 /3 下一条