原创 成功的ModelSim 仿真,简单的TestBench代码学习

2011-9-21 16:31 5065 6 7 分类: FPGA/CPLD
今天终于搞定了ModelSim的仿真,呵呵昨天没有出波形是因为自己居然不知道TestBench是要自己编写代码的,有点2了。。。
看在今天心情比较好,就把word文档慢慢弄上来吧 代码及文档见我的CSDN资源

蜂鸣器 引脚 Pin30 (低电平响)

复位引脚 Pin138(可能一般的IO引脚都可以做复位用吧)

时钟是Pin23

以上都是基于21EDA开发板

复习一下TestBench的建立

1processing>start>start test bench template write

2,建立好以后在simulation目录下打开,记得选all files(后缀为vt

打开,编写测试代码(昨天没有成功出波形的原因可能就是以为不需要再编写代码,(o)2了)

4,在assignments->settings ->simulation中添加test benches

20110921163046882.png

5,注意名字这里再重复一遍

test bench name :一般和工程名一样

Top level module in test bench :名字一般是vt文件定义时的名字一般后面有vlg_tst这样的字

Design instance name in test bench :一般为i1,这里要根据vt文件:ledtest i1 (

// port map - connection between master ports and signals/registers   

.clk_50M(clk_50M),

.dataout(dataout),

.rst(rst)

);

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文章评论1条评论)

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用户377235 2015-4-13 20:25

感觉还是么有懂啊,,求解,,第一:目前为止还不会编写测试文件;第二,你说的那些是基于Modelsin么》???还是ISE processing—>start—>start test bench template write assignments->settings ->simulation中添加test benches 这些目录在菜单中好像都没有呀

用户545978 2012-2-10 12:36

谢谢
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