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用户424052
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原创 verilog之“缩减运算符”

2013-8-28 16:28 5598 22 26 分类: FPGA/CPLD 文集: FPGA

reg[3:0]  B;

reg         C;

assign   C = &B;

相当于：C = (( B[0] & B[1] ) & B[2] ) & B[3] ;

注：其他位运算符（~, |, ^, &, ^~）都有类似用法；

verilog 缩减运算符
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文章评论（4条评论）

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用户424052 2015-11-25 09:04

同楼上回答
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用户424052 2015-11-25 09:03

~运算符本身就是对位取反，可以将其看成是缩减用法
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用户1850916 2015-8-21 16:24

楼主我一直有个疑问，那个~怎么做缩减运算，~它可是单目操作符啊。
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用户1702198 2014-10-23 15:52

若是 reg [3:0]C; assign C =~B; 这是什么运算？有什么区别？使用环境？
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用户424052
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