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用户1035710 2008-5-5 16:35: 关于C6000的引导过程的一点认识; 转载自华清远见嵌入式论坛，发帖者： GuanhuaYang 关于C6000的引导过程的一点认识我是这样认为的（有不对的希望大家指正）： CPU复位后首先把系统程序加 ...; 3306 7 0 7

用户1035710 2008-4-29 10:43: 关于关键字 volatile; 来自CCS的help: The compiler analyzes data flow to avoid memory accesses whenever possible. If you have code that depends on memory accesses exactly as ...; 3301 10 0 10

用户1035710 2008-4-9 15:23: 关于移位运算; 移位（bit shifting）移位只对整数运算起作用。通过移位进行2的整数次幂的乘除法要比直接进行乘法运算快很多（当然比除法运算更快），这是一个基本常识。为了 ...; 3072 12 0 12

用户1035710 2008-3-6 17:05: Cadence 学习笔记 - Capture CIS 篇（三）; 用表格做元件 SPB15.7中增加了用表格来做原理图元件的功能，对于引脚数较多的元件，这是个比较快捷方便的功能，我试了一下这个功能，下面讲下心得。 1，表格支 ...; 4433 9 0 9

用户1035710 2008-3-6 08:43: 关于EDIF的片言只语; EDIF - Electronic Design Interchange Format -----------------WiKipedia--------------------------- EDIF was an attempt to solve the problem stemmed f ...; 5066 10 2 12

用户1035710 2008-2-29 16:18: Cadence 学习笔记 - Allegro 篇（二）; 针对设计文件(*.brd)上只移动Symbol的「PIN」方法转自莎益博（古怪的名字）的论坛：图就不贴了，想看图就点击上面的连接。一、摘要： Allegro的初始设置 ...; 4060 7 0 7

用户1035710 2008-2-22 15:07: Cadence 学习笔记 - Capture CIS 篇（二）; 今天碰到一个问题，尚未解决：对于多个part组成的compent,比如双运放，其电源脚如何设置？在Protel中可以置为一个part上有电源脚而另一个没有，但是Capture中 ...; 3607 7 1 8

用户1035710 2008-2-21 13:20: Cadence 学习笔记 - Allegro 篇（一）; 以下开始记录在Cadence的学习过程中碰到的问题及解决方法，或心得或归纳。以SPB15.7为准，分 Capture CIS 和 Allegro 两部分。 ======================= ...; 5875 12 1 13

用户1035710 2008-2-21 13:18: Cadence 学习笔记 - Capture CIS 篇（一）; 以下开始记录在Cadence的学习过程中碰到的问题及解决方法，或心得或归纳。以SPB15.7为准，分 Capture CIS 和 Allegro 两部分。 =============== ...; 5908 11 0 11

用户1035710 2008-2-15 08:29: CONCEPT HDL和CAPTURE CIS的区别; 整理自PCBBBS论坛 CONCEPT HDL和CAPTURE CIS的区别之前一直用PROTEL,现在开始学习CADENCE,前几天装了CADENCE SPB 15.7。学习中有几个问题不明。 SPB中包含了 ...; 6162 9 0 9

用户1035710 2008-2-14 15:18: 温故知新之 RC多谐振荡器; 嘿嘿，说是温故知新，其实是都还给老师了-_-!; 3934 6 0 6

用户1035710 2007-1-19 17:03: 针对ECP/EC和XP器件的存储器使用指南连载之一; 此文档由本人翻译，如有错漏请以原版为主，转载请注明出处，谢谢！介绍 ?xml:namespace prefix = o ns = "urn:schemas-micro ...; 3721 7 0 7

用户1035710 2007-1-16 12:19: 原理图/语言混合设计; 有人问到关于原理图/语言混合设计问题，这里就说明一下。这是一个顶层为原理图，下层为VHDL文件的层次式设计，非常简单。例子是做的一个LCD显示程序，分 ...; 4416 8 0 8

用户1035710 2007-1-15 10:07: 开博; 上网搜资料，结果发现了这个BLOG，我先头已经开过2个，一个MSN的，以介绍影音为主，结果MSN的服务器超级慢，经常上不去，这次台湾稍微动了下，就根本不行了。 ...; 3531 9 1 10

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