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用户1432516 2009-3-12 21:53: 调好了DS1302; 用F2812调好了1302。调试的时候主要遇到了两个问题：1.GPIO读入的数据老是0xFF；2.GPIO解决了之后，1302秒位的跳变比较缓慢。先说 ...; 3076 7 0 7

用户1432516 2009-1-6 10:17: 运放的偏置电压，偏置电流; 运放是集成在一个芯片上的晶体管放大器, 偏置电流 bias current 就是第一级放大器输入晶体管的基极直流电流. 这个电流保证放大器工作在线性范围, 为放大 ...; 7718 7 0 7

用户1432516 2008-12-29 17:40: 阻抗匹配; 在网上看了一些资料，总结总结，没有详细的分析过程，大家可以补充！ 1.为什么要阻抗匹配？在能量传输时，可以使输出端的能量全部传输 ...; 2022 7 0 7

用户1432516 2008-12-29 15:13: 看看Linux; 随便看看Linux 张点儿知识最近熟悉了Emacs,Gcc,Gdb，还有很多的东西要把自己锻炼成嵌入式牛人----------------------中远期发展规划 ...; 2164 7 0 7

用户1432516 2008-12-18 11:02: TMD，FM25L04; 最近在调2812和FM25L04之间的SPI接口，一直有问题。都2个礼拜了，郁闷啊！我使用的是SPI Mode 0，2812的频率设为150Mhz，采用中断模式读取。有哪位 ...; 2652 8 1 9

用户1432516 2008-11-14 18:20: [转]单片机加密破解的常用方法及应对策略; 作者：52研究所徐礼荣来源：单片机及嵌入式系统应用介绍了单片机内部密码破解的常用方法，重点说明了侵入型攻击／物理攻击方法的详细步骤，最后 ...; 2500 8 0 8

用户1432516 2008-11-10 11:31: 硬件描述语言HDL; 今天借了一本Verilog的书看看。首先就谈到了Verilog这种HDL(Hardware Description Language)的历史。Verilog是由Phil Moorby于1983年在Aut ...; 2613 8 0 8

用户1432516 2008-11-6 22:14: 原来是你把频率给抬上去了; 今天终于找到问题了，有些高兴啊！使用2812进行AD转换，前几天还没有什么问题，但是自从上次把SystemClock升为75Mhz(原来是 ...; 2471 7 2 9

用户1432516 2008-10-24 22:21: 中兴VS华为：牛与狼的殊途同归; 从企业性格、创始人出身及处世风格，到企业体制、激励方式、管理思想、企业文化甚至发展战略，同一行业的两个不同核心企业居然会如此地截然不同 ...; 2680 6 0 6

用户1432516 2008-10-8 16:12: 多层电路板的设计; 多层板和双层板设计差不多甚至布线更Easy，但估计你买不到这类书籍(比较偏，没多少人看)。你有双层板的设计经验，多层就不难。 ...; 2309 6 1 7

用户1432516 2008-10-8 16:02: 2812的级联，双排序器，同步，顺序采样; 看了TMS320F2812的AD转换一节后，有些地方不是很懂，因此就用SEED-DSK2812v1.3试试，看到底是怎么回事？主要考虑级联，双排序器，同步，顺序采样这几种组合 ...; 3924 7 1 8

用户1432516 2008-10-6 22:17: 什么是PLL？; PLL的意思是Phase-locked Loop，中文意思即为锁相环。锁相环是一种反馈电路，其作用是使得电路上的时钟和某一外部时钟的相位同步。PLL通过比较外部信号的相 ...; 4447 11 2 13

用户1432516 2008-10-6 16:44: malloc指令和new指令的区别; 需要包含头文件：＃include 函数声明(函数原型)： void *malloc(int size); 说明：malloc 向系统申请分配指定size个字节的内存空间。返回类型是 voi ...; 3002 7 0 7

用户1432516 2008-9-28 11:53: TTL电平和CMOS电平; 1，TTL电平(什么是TTL电平)：输出高电平2.4V,输出低电平0.4V。在室温下，一般输出高电平是3.5V，输出低电平是0.2V。最小输入高电平和低电平：输入高电平= ...; 2050 8 0 8

用户1432516 2008-9-28 10:33: OC门与OD门; 什么是集电极开路（OC）？我们先来说说集电极开路输出的结构。集电极开路输出的结构如图1所示，右边的那个三极管集电极什么都不接，所以叫做集电极开路（左 ...; 2880 8 0 8

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