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用户1740764 2014-3-29 15:19: 利用有限状态机进行复杂时序逻辑的设计; 　　 EDN博客精华文章作者： ilove314 　　利用有限状态机进行复杂时序逻辑的设计：　　目的：掌握利用有限状态机实现复杂时序逻辑的方法。　 ...; 1432 16 0 16

有限状态机 Verilog 时序逻辑

用户1740764 2014-3-29 15:01: 对C语言编程者的Verilog开发指南实例; 　　本文举例说明了如何用软件实现脉宽调制( PWM )，如何将该设计转换成一个可以在 FPGA 中运行的逻辑块，并能利用存储器映射I/O接口通过软件完成对该逻辑块的 ...; 1006 10 0 10

verilog PWM FPGA C语言

用户1740764 2014-3-29 14:55: 基于Verilog的顺序状态逻辑FSM的设计与仿真; 　　硬件描述语言Verilog为数字系统设计人员提供了一种在广泛抽象层次上描述数字系统的方式，同时，为计算机辅助设计工具在工程设计中的应用提供了方法。该语言 ...; 1296 14 0 14

Verilog 顺序状态逻辑 FSM

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