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用户582175 2014-7-17 14:37: 评论：@特权's Blog——永远忠于年轻时的梦想！博客中提到的“经典三星SDR SDRAM读写verilog代码分享”; 先mark; 984 10 0 10

用户582175 2014-7-14 10:22: 评论：@sujiebin's Blog 博客中提到的“如何从零开始开发一款嵌入式产品（转自一老工程师）”; mark; 670 7 0 7

用户582175 2014-5-23 09:25: 基于FPGA的跨时钟域信号处理——同步设计的重要; 上次提出了一个处于异步时钟域的MCU与FPGA直接通信的实现方式，其实在这之前，特权同学想列举一个异步时钟域中出现的很典型的问题。也就是要用一个反例来说明没 ...; 719 10 0 10

FPGA，跨时钟域信号，异步时钟

用户582175 2014-5-17 17:29: Verilog串口通讯设计; 　　1 串口通信基本特点　　随着多微机系统的应用和微机网络的发展，通信功能越来越显得重要。串行通信是在一根传输线上一位一位地传送信息.这根线既作 ...; 932 9 0 9

串口 FPGA Verilog SP3485

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