《VHDL数字电路设计教程》主要讲述硬件描述语言VHDL及其在数字电路设计中的建模和仿真，内容包括VHDL语言学习基础、语法规则和模型结构、数字电路的VHDL建模、VHDL硬件描述等。本书在内容结构的组织上有独特之处，如将并行描述语句、顺序描述语句、数据类型与运算操作符和属性等独立成章，使读者更容易清晰准确地掌握这些重要内容。本书注重设计实践，给出了大量完整设计实例的电路图、相关基本概念、电路工作原理以及仿真结果，从而将VHDL语法学习和如何采用它进行电路设计有机地结合在一起，并通过深入浅出的操作点拨，提升学生对VHDL的理性认识，提高学生的研究能力。 《VHDL数字电路设计教程》可作为高等院校电子工程、通信工程、自动化、电气工程等专业的教材及实验指导，也可作为相关专业技术人员的自学参考书。