原创 【博客大赛】Altera ALTMEPHY DDR2应用和仿真--基于QuartusII下例化的IP

2014-2-9 15:58 5363 27 35 分类: FPGA/CPLD 文集: Altera高速接口

Altera ALTMEPHY DDR2应用和仿真

--基于QuartusII下例化的IP

KevinWan

Modelsim仿真(本文是基于QuartusII下例化的IP,非Qsys

编译如下库:

20140209153719225001.png

 

需要编译一下子文件,可以添加在.do文件里,让Modelsim自动编译

20140209153736431002.png

20140209153748549003.png

然后自己编写简单的testbench既可以仿真。

本文采用.do文件让Modelsim自动仿真,自动仿真的方法由另外一篇文章有介绍。

20140209153800161004.png

 

自己可以建一个.bat文件,直接运行即可:

20140209153805651005.png

 

DDR2的仿真波形图

20140209153821719006.png

 

20140209153834751007.png

代码设计和硬件调试

         QuartusII下代码主要判断local ready信号和local_rdata_valid信号有效,对于初始化,两者具有相同的特性。

写信号波形

20140209153844619008.png

 

读信号波形

20140209153854910009.png

 

文章评论8条评论)

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用户211539 2015-9-28 16:13

可以QQ聊:278167605

用户1826728 2015-8-13 19:37

能不能把仿真的流程说得具体一点,如果自己设计的顶层文件,该怎样修改仿真文件呢

用户1766767 2015-3-13 13:21

我也搞疯了,ddr2 我用例化的IP核仿真出来是test_complete信号等,没有Local_ready啊这是怎么回事?

用户377235 2015-3-5 11:44

楼主,我快被DDR ip给搞哭了,请问要用modelsim仿真4秒到第三秒的时候local_init_done才能置高?请千万回复!

用户377235 2014-12-8 16:20

贴几张图,等于没讲,一些重要的设置,要修改的地方。。。。根本不是写给一般人看的

用户377235 2014-5-30 11:14

两种仿真图上面的local_burstbegin 不一致啊,上面的local_burstbegin 一直是滴电平,下面的都是高电平,这个信号在读写时到底要怎么设置啊?

用户447841 2014-4-8 08:57

楼主,为啥我用这个ip核自带的仿真例子能跑,但是修改了这个ip核的驱动代码,仿真时老是跑不起来,local_init_done信号一直拉不高,楼主有没有遇到这个问题呢?

用户403664 2014-2-12 14:27

http://weibo.com/2687789041/AwmrD4ZuM Altera官方微博都转发了撒~
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