原创 verilog的小陷阱

2009-8-8 20:45 1438 5 7 分类: 工程师职场
reg [15:0] a,b,ans;
ans = (a+b)>>1;//式1
ans = (a+b+0)>>1;//式2

其中式1可能会出错,式2不会出错。

文章评论2条评论)

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用户212292 2009-8-13 22:50

1会溢出, 2不会溢出

270846509_364374440 2009-8-10 12:29

能说说为什么吗?
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