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提升毫米波信号测试精度 直播时间： 12月18日 14:00 -
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pengchengcheng082_593158939 2014-2-21 21:09
- altera fpga 芯片中 pin 和 pad 区别
- 在chip planner 中 ，看管脚时，会看到 pin 和pad 同时出现， 如 pin120/pad174 Bank 4 那么有什么区别？ PIN指芯片封装好后的管脚，即用户看到的管脚 ...
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- altera FPGA 内部结构
- 1、芯片资源情况，可以看数据手册，也可以在Quartus中选型时查看，如下 2、FPGA 芯片包括 逻辑单元（LE），LE由LUT和register组成，16个LE组成一个 ...
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- verilog奇数分频器
- 分频器是FPGA设计中使用频率非常高的基本设计之一，尽管在目前大部分设计中，广泛使用芯片厂家集成的 锁相环 资源，如赛灵思（Xilinx）的DLL.来进行时钟的 ...
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- Latch 和 Register 区别 ？编程时如何避免锁存器 ？
- 1、锁存器Latch 和 触发器flipflop 锁存器能根据输入端把结果自行保持;触发器是指由时钟边沿触发的存储器单元； 由敏感信号（电平，边沿）控制的锁存器 ...
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- ROM、PLA、PAL、CPLD、FPGA内部结构
- 1、二极管ROM内部构成 与阵列，或阵列，输出 三部分构成 任何组合逻辑函数都可以把每个输出端写成输入端最小项和的形式，即输出端等于各输 ...
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- FPGA和CPLD区别
- FPGA 与CPLD的辨别和分类 主要是根据其 结构特点和工作原理 。通常的分类方法是： 将以乘积项结构方式构成逻辑行为的器件称为CPLD ，如Lattice的ispLS ...
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- 可编程逻辑器件的发展历程
- 数字集成电路由早期的电子管、晶体管、小中规模集成电路、发展到超大规模集成电路(VLSIC，几万门以上)以及许多具有特定功能的专用集成电路。但是， ...
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- verilog中的有符号数运算（转）
- verilog中的有符号数运算 有符号数的计算：若有需要关于有号数的计算，应当利用Verilog 2001所提供的signed及$signed()机制。 Ex: inp ...
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- multstyle Verilog HDL Synthesis Attribute
- multstyle Verilog HDL Synthesis Attribute A Verilog HDL synthesis attribute that specifies the implementation style for multiplication operatio ...
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- 很经典，逻辑电路设计经验（转）
- 规范很重要 工作过的朋友肯定知道，公司里是很强调规范的，特别是对于大的设计（无论软件还是硬件），不按照规范走几乎是不可实现的。逻辑设计 ...
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- verilog之generate的使用
- Verilog-2001添加了generate循环，允许产生module和primitive的多个实例化， ...
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- defparam的用法
- parameter是一个模块中，常量是声明 defparam是对已经声明的模块常量，在例化的时候对这个常量的数值进行修改， define啊，比如一个模块内同时写了针对FPGA ...
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- verilog 2001
- 1.Verilog-2001的由来 Verilog HDL 虽 然得到了广泛应用，但是人们在应用过程中也发现了Verilog的不少缺陷。在2001年，O ...
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- FIR滤波器的FPGA实现方法
- FIR滤波器的FPGA实现方法 时间： 2011-02-12 14:12:45 来源：现代电子技术 作者：徐远泽，戴立新，高晓蓉，王 黎，郭建强 在数字信号处 ...
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- QUARTUS II中IP核的调用方法（图文详解）
- 很多人都说QUARYUSII中的IP核是收费的，不可以直接用的，其实不然，下面我以FIR滤波器的核的使用来给大家介绍IP核的使用，希望对大家有点帮助。 1.使 ...
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