原创 电路板修改后之前加的等长约束出现问题处理

2024-5-20 14:30 335 1 2 分类: PCB 文集: Cadence

差分对等长约束问题处理

概述

最近需要修改电路板,进行差分对等长处理的时候,之前加的差分对约束出现问题,具体如图1所示,差分对F2CLK的F2CLK_N网络重复囊括了两端IC到电阻R85线段,而不是象P端那样只是两个IC两个PIN直接的线段。

图1:差分对某个分支出现“重复”线段

造成这个问题的原因是分析的时候认为R85的模型为IC,而不是分离阻容。解决该问题的方法有很多,这里给出两种。

解决方法一

在Allegro的PCB Editor的Analyze菜单下选择Model Assignment...命令,如图2所示。之后进入SI Design Audit界面,在该界面下不要进行任何操作,直接点击ok按钮进入下一个界面。

图2:

在弹出的对话框直接选择“Yes”,进入Signal Model Assignment界面,如图3所示。在图3所示的界面之间执行“Auto Setup”命令,完成后点击ok按钮退出Signal Model Assignment界面即可。

图3:

完成以上操作后,还需要将之前出问题的差分对约束全部删除,并重新创建即可解决上述问题了。

解决方法二

切换下软件工作环境,如图4所示,用SI。切换后,用Logic,用partlist命令点击阻容后,如图5所示。

D:.Documents.Tencent Files.969737034.Image.C2C.$CAW%0)_`$JF7L4@Q71N0O0.jpg

图4:

D:.Documents.Tencent Files.969737034.Image.C2C.4PBCG_LRQT1`PLEUIPE{R[O.png

图5:

如图5所示,在Class属性下,阻容的属性为IC。修改成分离器件,然后点击Modify,最后保存,返回到之前画图环境就OK了。

参考

[1] 于博士视频

作者: coyoo, 来源:面包板社区

链接: https://mbb.eet-china.com/blog/uid-me-1010859.html

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开发工匠 2024-6-5 09:35

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