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用户208177 2010-2-24 13:22: 安装Siwave3.0与Allegro15.2以上版本交互; Install Siwave AnsoftLinks With Cadence Co-Working ?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" / 很 ...; 6198 4 0 4

yoyowind 2010-2-23 00:31: 画了块MCF52233的准最小系统板PCB。; 片子太少了，也没法多做，没什么多余的功能，只有4个小灯。大小约为8*6cm。回头加工出来玩玩。另外，还需要做个多功能板，至少支持以太网和SD卡等，一般的功能就 ...; 1449 5 0 5

yoyowind 2010-2-23 00:31: 非常有用的资料----钽电容封装大全。; formatted in JPG.; 1262 4 0 4

yoyowind 2010-2-23 00:31: 关于PROTEL原理图。; 其实PROTEL原理图是电路的一个原理，而不是布局。有人曾经问我这个硬件菜鸟，为什么在建SCH库的时候，芯片的引脚不是按顺序排列的。我回答如此。但是我想他一 ...; 2290 11 0 11

yoyowind 2010-2-22 23:22: 一个转BMP为PCB的软件，可以在PCB上添加各种图形和汉字。; 这个附件上传功能是怎么回事？老是传不上？; 1803 5 0 5

yoyowind 2010-2-22 23:22: 又做了一块MCF52235 112pin的开发系统。; 这个跟我前几天做的MCF52233的最小系统有本质的区别了，外设资源相当丰富，其中以太网，IIC的温度传感器，485总线，板载的BDM，加速度传感器，RS232，LED灯，数 ...; 1818 4 0 4

yoyowind 2010-2-22 18:26: ColdFire 冷火处理器的调试下载器（BDM）制作完毕。; ColdFire 冷火处理器的调试下载器（BDM）制作完毕。现有少量空板和极少成品，需要可以联系我。; 2206 5 1 6

用户208177 2010-2-22 10:37: Cadence Simulation Flow; Cadence仿真流程介绍; 2752 3 0 3

用户163057 2010-2-17 19:00: PCB Layout 中的直角走线、差分走线和蛇形; 布线（Layout）是PCB设计工程师最基本的工作技能之一。走线的好坏将直接影响到整个系统的性能，大多数高速的设计理论也要最终经过 Layout 得以实现并验 ...; 2005 10 0 10

用户377539 2010-2-14 19:50: 在家画PCB; 最近在家闲着没事就在画PCB，重做了几个做过的作品，重新绘制了PCB，使用PADS2005，一方面学习PADS。还有就是重温以前自己做过的东西。贴几个图大家踩踩 ...; 3809 10 6 16

用户264922 2010-2-12 00:12: 热转印又一力作; PCB表面镀锡，效果非常不错。; 1381 2 0 2

用户208177 2010-2-10 21:59: Route & Topology; 布线操作布线过程中会遇到很多具体的小问题，首先学习一下 Drawing Options Unplaced Symbols 表示有多少个未摆放器件，绿色表 ...; 4349 5 0 5

用户208177 2010-2-10 21:47: Making Constraints In Allegro; 约束规则的制定与约束网络的分配差分约束规则：差分线其实可以看做是特殊的一组网络，一对差分网络包括两条线，从物理约束规则方面来考虑，需要 ...; 4862 3 0 3

用户208177 2010-2-10 21:31: Fanout About SMD; SMD 元件的扇出 (Fanout) 主要是为了后续布线的时候更方便的进行内层走线，尤其是多层板。一般在布局的时候，就可以进行相关元件的扇出工作了，如 BGA ...; 5087 3 0 3

用户208177 2010-2-10 21:15: SI Basic Knowledge; Reflect 反射是引起 SI 的一个最基本因素，信号在传输线传播过程中，一旦它所感受到的传输线瞬时阻抗发生变化，那么就必将有发射发生。反射 ...; 10304 3 2 5

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