用户111218
2008-1-18 13:42
FPGA设计注意事项
1.一个模块尽量只用一个时钟, 在多时钟域的设计中设计到跨时钟域的最好有专门一个模块做时钟域的隔离。利于综合器综合。 2.尽量在底 ...
用户111218
2008-1-11 11:28
IC测试原理-存储器和逻辑芯片的测试
1 存储器术语的定义 在讨论存储器芯片测试之前，有必要先定义一些相关的术语。 写入恢复时间(Write Recovery Time)：一个存储单元在写入操作之 ...
用户111218
2007-12-27 10:51
synplify tool
最近不忙，正好可以研究一下综合工具。
用户111218
2007-11-23 16:59
FPGA的一点总结
riple网友说：“写作是最好的学习方式”。所以我决定从现在开始就把自己所学所领悟的写出来，一方面是为了自我总结，另一方面也希望能对需要的同行们起到 ...
用户111218
2007-11-7 15:27
时序不满足
对于时序不满足这种情况，多数还是在逻辑中找原因。我用了全局时钟，而不是用分频器产生的时钟，上面那个警告就自然消失了。也许有更好的办法，这可能只是 ...
用户111218
2007-11-2 15:34
专业英语的重要性
英语的重要性就是在你用这个西方软件的时候，能够明白它每一项都有什么功能。我的可怜的英语，阻 碍了我工作的进展。看来得要狠狠的补一补了~ ...
用户111218
2007-11-1 11:18
在quartus中遇到的时序警告
Critical Warning: Timing requirements were not met. See Report window for details. Warning: Found invalid timing assignments -- see Ignored Timing As ...
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