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用户61970 2007-8-14 00:46: 有问题大家发邮件给我吧！; 现在预计到9月底也没有太多的时间写blog文章了。计划赶不上变化啊，由于需求变更，现在我是指导上板调试一个版本，编码调试一个临时版本，指导设计一个新版 ...; 3644 7 3 10

用户61970 2007-6-10 23:13: 好久没有上来，给大家先道个谦; 现在这个项目实在是累人，进度紧、难度大就不说了，还经常发生需求变动，幸好不是大的变动，不然真的要死人了…… 终于在本周完成了所有的代码和UT，统计结果 ...; 4026 6 0 6

用户61970 2007-2-4 22:36: 静态时序分析：Tsu、Tco; 首先需要注意的是，这里讨论的都是静态时序分析。所谓静态时序分析，就是只针对FPGA内部布线后生成的实际布线结果来计算理论时序，同时采用的模型为理论模型。 ...; 7333 6 4 10

用户61970 2007-1-10 22:47: 问题答复; to yangss2006：我的邮箱： fy2kdonews@yahoo.com.cn ，欢迎大家发邮件。 init_flag信号是FPGA来产生的吗？如果是，可以用下面的方式来产生： always ...; 4879 9 1 10

用户61970 2007-1-1 23:32: 大家提的一些问题的答复; 最近刚忙完一个老逻辑项目的优化工作，把性能提升了一倍。节后马上又要开始一个新项目，难度很大，带宽有10G，6月份就要完工。估计元旦后的空闲时间又不多了， ...; 4815 9 6 15

用户61970 2006-12-11 23:13: 希望大家在回复中多提问题; 最近2周一直在忙一个逻辑优化工作，总共写了5000多行，外加所有的单元仿真和系统仿真。好累！现在要做系统仿真和上板测试了，估计最近2周晚上也没有空来更新 ...; 4226 11 4 15

用户61970 2006-12-5 22:47: FPGA设计要点之四:逻辑仿真; Hehe, 今天用了个手写板, 感觉还不错，虽然速度慢，但是可以练习写字，老用键盘都不会写字了。仿真是FPGA设计中必不可少的一步。没有仿真，就没有一切。 ...; 4199 9 4 13

用户61970 2006-12-5 22:47: FPGA设计要点之四:逻辑仿真; Hehe, 今天用了个手写板, 感觉还不错，虽然速度慢，但是可以练习写字，老用键盘都不会写字了。仿真是FPGA设计中必不可少的一步。没有仿真，就没有一切。 ...; 4226 7 0 7

用户61970 2006-11-28 22:07: FPGA设计之三：latch; 首先回答一下： 1）stateCAD没有用过，不过我感觉用这个东东在构建大的系统的时候似乎不是很方便。也许用system C或者system Verilog更好一些。 2）同步、 ...; 6481 9 2 11

用户61970 2006-11-24 22:44: FPGA设计要点之二：FSM; 很开心，终于有回复了！工作一直很忙，只能时不时的抽空上来写点东西了。关于上期的时钟树，可能说的不是很确切。这里的时钟树实际上泛指时钟方案，主要 ...; 5704 6 5 11

用户61970 2006-11-21 22:42: FPGA设计要点之一：时钟树; 对于FPGA来说，要尽可能避免异步设计，尽可能采用同步设计。同步设计的第一个关键，也是关键中的关键，就是时钟树。一个糟糕的时钟树，对FPGA设计来说， ...; 6988 9 2 11

用户61970 2006-11-19 21:16: FPGA的用处; FPGA的用处比我们平时想象的用处更广泛，原因在于其中集成的模块种类更多，而不仅仅是原来的简单逻辑单元（LE）早期的FPGA相对比较简单，所有的功能单元仅仅 ...; 4770 11 3 14

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