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热门搜索： python HarmonyOS 嵌入式 电源 C语言 华为 电子竞赛 单片机 PCB
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  • 基于CPLD/FPGA平台I2C总线IP核的设计
    所需E币：1
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    大小：731.26KB
    时间：2019.06.28
    上传者：xld0932
    本文通过对一个I2C总线IP核的设计，介绍了用VHDL语言设计和实现该IP核的过程。首先简要地介绍了I2C总线协议的标准及应用，分析了影响8位MPU的传输速率低的因素，继而提出了基于CPLD/FPGA
  • 基于CPLD与DSP的数字式电抗器的设计
    所需E币：1
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    大小：479.86KB
    时间：2019.06.28
    上传者：xld0932
    为了更为准确可行地根据系统内无功状态进行抵消电力线电容效应，设计了一种可以根据系统实时运行状态平滑输出所需感性无功的数字式电抗器。该数字电抗器通过控制二次侧逆变器来改变本身电感线圈的感性电流以尽量抵消
  • 基于CPLD与VHDL语言的数字钟设计
    所需E币：1
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    大小：1.18MB
    时间：2019.06.28
    上传者：xld0932
    文章介绍了一种利用CPLD进行数字钟设计的方法，设计中采用VHDL语言进行每个模块程序的设计，实现利用数码管进行时、分、秒的显示，利用按键进行时间的设置与调整，并且在CPLD实验板上进行了验证，实现了
  • 基于CPLD内置UFM的嵌入式加速度采集系统
    所需E币：1
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    大小：1.18MB
    时间：2019.06.28
    上传者：xld0932
    介绍了一种基于CPLD内置UFM(userflashmemory)的嵌入式加速度数据采集系统，并给出了各个功能模块的实现方法。整个采集系统主要包括电荷放大器模块、信号调理模块、A/D转换模块、CPLD
  • 基于CPLD和AD9709的多用途信号源设计
    所需E币：1
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    大小：1.03MB
    时间：2019.06.28
    上传者：xld0932
    给出一种基于单片机C8051F020为主控，CPLD控制高速DA芯片AD9709产生多用途信号的设计，输出信号具有较高的分辨率，可以较好地模拟各种板级调试和软件集成调试所需的检测信号，且人机界面友好，
  • 基于CPLD和ARM完成短波发射机自动调谐控制的设计与实现
    所需E币：1
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    大小：131.77KB
    时间：2019.06.28
    上传者：xld0932
    伴随着电子技术的快速发展，广播行业也在逐渐迎来新的发展时期，特别是有人留守和无人值班的运行管理模式推出之后，广播行业中的短波发射机自动化运行已经成为其必然的发展趋势，而想要实现这一模式的正常运行，自动
  • 基于CPLD和AVR的图像采集系统设计
    所需E币：1
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    大小：1.37MB
    时间：2019.06.28
    上传者：xld0932
    工业生产和生活领域有许多图像采集和监控需求，并且要求也越来越高，大部分传统的图像监测装置已经不能满足现状,不利于大范围的使用和推广。本方案正是以此为出发点，设计一种基于CPLD和AVR的高速、低功耗图
  • 基于CPLD和DS1020的多道数字延迟脉冲发生器
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    大小：1.32MB
    时间：2019.06.28
    上传者：xld0932
    讨论了一种可用于飞行时间质谱仪（TOF）的小型多通道时序系统，研制一种新型高精度的可编程数字延迟/脉冲发生器。采用单片机（MCU）作为微控制器，通过可编程逻辑器件（CPLD）和可编程数字延迟线（DS1
  • 基于CPLD和DSP的高精度永磁同步电动机驱动控制器的设计与实践
    所需E币：1
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    大小：314.45KB
    时间：2019.06.28
    上传者：xld0932
    随着永磁同步电机的广泛应用，对控制系统的性能要求更高，不单要具备较高的控制精度及性能，还要尽量降低系统成本。文中从永磁同步电动机控制原理入手，分析该永磁同步电动机的特点及其分类，介绍基于CPLD、DS
  • 基于CPLD和ISA总线的IO端口扩展
    所需E币：1
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    大小：205.14KB
    时间：2019.06.28
    上传者：xld0932
    提出了一种使用复杂可编程逻辑器件(CPLD)实现ISA总线扩展IO端口的解决方案，分析了ISA通信接口、输入输出接口和控制单元设计要点，同时给出读写数据流程。设计的端口扩展模块稳定可靠。
  • 基于CPLD和VHDL的CCD驱动时序电路设计
    所需E币：1
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    大小：2.72MB
    时间：2019.06.28
    上传者：xld0932
    本文描述了彩色线阵CCD-TCD2252D驱动电路的时序关系，介绍了一种基于CPLD和VHDL的CCD驱动时序电路设计方法。采用QuartusII9.0对所设计的驱动时序进行仿真，给出了驱动电路的设计
  • 基于CPLD和单片机的等精度数字频率计设计
    所需E币：1
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    大小：2.77MB
    时间：2019.06.25
    上传者：xld0932
    根据相位重合点理论对等精度数字频率计进行改进，采用该理论可使对标准频率信号和待测频率的计数同时开始，消除了对标准频率信号计数时±1个周期的误差。系统设计主要包括三部分：待测频率的整形放大部分；计数部分
  • 基于CPLD器件的智能交通灯控制系统设计
    所需E币：1
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    大小：1.29MB
    时间：2019.06.28
    上传者：xld0932
    针对目前车辆流量的不断增加，交通灯指挥控制系统设置不合理引起的交通堵塞日益严重的现象，提出了一种基于复杂可编程逻辑器件（Ｃｏｍｐｌｅｘｐｒｏｇｒａｍｍａｂｌｅｌｏｇｉｃｄｅｖｉｃｅ，ＣＰＬＤ）的智能型
  • 基于CPLD地铁售票控制系统的设计
    所需E币：1
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    大小：1.65MB
    时间：2019.06.28
    上传者：xld0932
    目前，城市交通拥堵已成为了一个世界性的难题，各国在面对这一问题时，往往采用建设容量大、速度快的轨道交通加以应对。随着轨道交通规模的不断扩大，对地铁售票机技术提出了更高的要求。尤其是计算机、人工智能和电
  • 基于CPLD天幕靶抗外界干扰技术研究
    所需E币：1
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    大小：373.2KB
    时间：2019.06.28
    上传者：xld0932
    为了解决天幕靶输出的目标信号容易受到外界干扰的难题，研究了天幕靶输出真实的目标信号和外界干扰信号的特点，提出了基于ＣＰＬＤ建立抗干扰电路，可以对目标信号和干扰信号进行有效的区分，并通过仿真实验和具体的
  • 基于CPLD实现FPGA的SPI Flash配置
    所需E币：1
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    大小：2.49MB
    时间：2019.06.28
    上传者：xld0932
    FPGA在电子通信领域是一种用途广泛的可编程逻辑器件,能否选择合适的程序配置方式是一个重要的问题,关系到FPGA上电后能否快速可靠地进入到工作状态。通过设置FPGA为从串配置模式,利用SPIFlash
  • 基于CPLD电子脱扣器设计与功能测试
    所需E币：1
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    大小：253.87KB
    时间：2019.06.28
    上传者：xld0932
    直流断路器是确保舰船供配电系统和用电设备安全的重要开关设备之一，而断路器的故障保护功能最终是由脱扣器来控制完成的。本文按照舰船某型直流限流装置的功能需求，完成了对基于CPLD电子脱扣器的设计，对该脱扣
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