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  • FPGA设计经验谈
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    时间：2019.08.05
    上传者：328230725_895182095
    在数字电路的设计中，时序设计是一个系统性能的主要标志，在高层次设计方法中，对时序控制的抽象度也相应提高，因此在设计中较难把握，但在理解RTL电路时序模型的基础上，采用合理的设计方法在设计复杂数字系统是
    fpga
  • FPGA基础知识
    所需E币：1
    下载：12
    大小：2.13MB
    时间：2019.07.29
    上传者：328230725_895182095
    1、查找表LUT和编程方式第一部分：查找表LUTFPGA是在PAL、GAL、EPLD、CPLD等可编程器件的基础上进一步发展的产物。它是作为ASIC领域中的一种半定制电路而出现的，即解决了定制电路的不
    fpga
  • 《FPGA权威指南(英文版)》
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    下载：7
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    时间：2019.07.29
    上传者：328230725_895182095
    《FPGA权威指南(英文版)》英语不好的，就算了
    fpga
  • 写给小白们的FPGA入门设计实验-打包合集资料
    所需E币：3
    下载：81
    大小：4.13MB
    时间：2019.07.25
    上传者：328230725_895182095
    本份资源包括书和随书代码，书中介绍了LCD1602字符显示设计，4位加减法设计，三位二进制乘法器设计，序列检测器设计，变模计数器设计，流水灯设计，简易电子时钟设计，简易计算器设计共8个小白入门常用的实
  • VHDL 语法
    所需E币：1
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    大小：298.43KB
    时间：2019.07.11
    上传者：羽翎果
    关于VHDL的语法介绍，英文版的，通俗易懂，都是比较基础的东西。
    可编程器件
  • Verilog Hardware Description Language
    所需E币：1
    下载：8
    大小：2.87MB
    时间：2019.07.08
    上传者：agdhun_799594606
    TheVerilogHardwareDescriptionLanguage(HDL)isdefinedinthisstandard.VerilogHDLisaformalnotationintende
  • 基于FPGA和虚拟仪器的DDS信号发生器设计
    所需E币：3
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    大小：652.97KB
    时间：2019.07.01
    上传者：royalark_912907664
    基于FPGA和虚拟仪器的DDS信号发生器设计
  • 基于FPGA的实时视频信号处理平台的设计
    所需E币：3
    下载：1
    大小：618.05KB
    时间：2019.07.01
    上传者：royalark_912907664
    基于FPGA的实时视频信号处理平台的设计
  • 基于FPGA的洗衣机控制系统设计
    所需E币：3
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    大小：680.59KB
    时间：2019.07.01
    上传者：royalark_912907664
    基于FPGA的洗衣机控制系统设计
  • 基于DSP+FPGA的磁铁电源控制器的设计
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    大小：442.82KB
    时间：2019.07.01
    上传者：royalark_912907664
    基于DSP+FPGA的磁铁电源控制器的设计
  • 基于FPGA的DDS基本信号发生器的设计
    所需E币：3
    下载：1
    大小：874.54KB
    时间：2019.07.01
    上传者：royalark_912907664
    基于FPGA的DDS基本信号发生器的设计
  • 基于FPGA的数字稳定校正单元的实现
    所需E币：3
    下载：0
    大小：1.27MB
    时间：2019.07.01
    上传者：royalark_912907664
    基于FPGA的数字稳定校正单元的实现
  • 基于NiosII软核处理器的步进电机接口设计
    所需E币：3
    下载：1
    大小：646.47KB
    时间：2019.07.01
    上传者：royalark_912907664
    基于NiosII软核处理器的步进电机接口设计
  • 基于FPGA的34位串行编码信号设计与实现
    所需E币：3
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    大小：549KB
    时间：2019.07.01
    上传者：royalark_912907664
    基于FPGA的34位串行编码信号设计与实现
  • 基于FPGA部分动态可重构的信号解调系统的实现
    所需E币：3
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    大小：534.53KB
    时间：2019.07.01
    上传者：royalark_912907664
    基于FPGA部分动态可重构的信号解调系统的实现
  • 基于VHDL的MTM总线主模块有限状态机设计
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    大小：464.71KB
    时间：2019.07.01
    上传者：royalark_912907664
    基于VHDL的MTM总线主模块有限状态机设计
  • 基于FPGA的喷油脉宽处理系统的设计
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    大小：508.6KB
    时间：2019.07.01
    上传者：royalark_912907664
    基于FPGA的喷油脉宽处理系统的设计
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