原创【博客大赛】先识庐山真面目

 2015-3-9 21:39  1132 14 14 分类: FPGA/CPLD 文集: FPGA

在真正开始做项目或者进行设计之前，最好先对平台进行一定的了解，知道树木也要知道树林，这样你才不会在里面一直打转。所谓不识庐山真面目，只缘身在此山中，根本原因就是你对事物没有一个整体的把握。把握整体后然后选择性的各个击破，这样学习或者工作的效率会更加快而又效率

开发板概貌

一：套件具有如下资源

板载一个50MHZ晶振

8个模拟输入I/O，14个Arduino I/O,40个通用I/O

5个用户LED

一个绿色LED显示USB连接

一个重新配置按键

一个寄存器复位按键

一个6位拨码开口

MAX10M08S具有

8，000个LE

378KB M9K memory

32-172(KB)用户存储空间

一个12bitADC 1MSPS（一百万次采样每秒）

JTAG可有外部USB-Blaster、USB-Blaster II 或者Ethernet Blaster 调试

双配置文件

二、MAX10 FPGA 芯片资源如下：

时钟和锁相环：Clocks and Phase-Locked Loops（PLL）

通用I/O：General Purpose Input Output Port

高速低压差分信号I/O口：High - Speed LVDS I/O

外部存储接口：External memory interfaces

逻辑阵列块：Logical Array Blocks（LABs）

模数转换：ADC

用户存储：User flash Memory （UFM）

嵌入乘法器模块：Embedded Multiplier Blocks

嵌入存储模块：Embedded Memory Blocks（M9K）

配置存储控制器：configuration Memory control（CFM）

三QuartusII 分配管角时的芯片概貌

博客大赛 max10

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