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ash_riple
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http://www.altera.com/literature/manual/stx_cookbook.pdf
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2008-3-5 21:53
从PFL megafunction中学到的Virtual JTAG使用技巧
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2008-3-5 21:51
Virtual JTAG仿真要点(附图)
Virtual JTAG仿真要点图形说明。从下图可以看出Virtual JTAG与Real JTAG的对应关系。下面两幅Modelsim仿真截屏的上半部分是VJI命令发出后Real JTAG的状 ...
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2008-2-26 18:26
为什么Micron的NAND Flash能达到200MB/s的读取速度
20080226写了《为什么Micron的NAND Flash能达到200MB/s的读取速度》,放在了“接口电路”分类下。奇怪的是,这篇文章并没有出现在“接口电路”分类下的 ...
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ash_riple_768180695
2008-2-10 21:55
授人以渔——Altera网站上的电子教程
记得在读研究生时,曾经在Altera的网站上下载了几个电子教程,对我帮助很大。后来在学习使用一些新功能时也下载了几个。前些天在Altera网站上搜索Virtua ...
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ash_riple_768180695
2008-2-1 19:09
Virtual JTAG相关链接
使用VJ的人越来越多了,多好! http://www.antfarm.org/blog/aaronf/2007/08/xii_gathering_the_xbox_dvd_rem.html http://www.alteraforum.com/f ...
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ash_riple_768180695
2008-1-29 17:40
Virtual JTAG的Xilinx等价工具——BSCAN
偶然在Xilinx的网站上发现了等价的工具BSCAN: Using the JTAG Interface as a General-Purpose Communication Port riple http://tool ...
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2008-1-29 14:19
FSM的安全选项——“安全”意味着什么?
Quartus II中的Safe State Machine编译选项对FSM在FPGA中的实现方式有很大影响。 riple 这一影响在RTL视图中不可见。 riple ...
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2008-1-29 13:41
FSM的状态编码——还是托付给综合工具吧
在Quartus II的Assignment Editor里可以指定任意一个FSM的状态编码方式;在编译报告里可以看到FSM的最终状态编码。即使选用User-Encoded的方式,也有可 ...
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2008-1-29 13:13
FSM的时序优化——输入逻辑预计算和流水化
1. 跨时钟域同步。对于FPGA的异步输入信号,这是必须的,对于FSM更是如此。因为没有跨时钟域信号的前级驱动时钟特性信息,所以需要在同步器前设置时序约束:fal ...
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2008-1-20 23:09
TimeQuest就一定要搞定——时序约束和分析流程
TimeQuest的约束和分析流程是与Quartus II的编译流程紧密结合的。如下图所示: TimeQuest进行约束和分析的对象都来自Quartus II编译流程各 ...
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2008-1-11 17:20
手工改变Quartus II软件的编译速度
Quartus II的编译速度一直是个问题:太慢!尤其在进行FPGA调试时,加入SignalTAP II后编译时间明显延长,一次就要15分钟(对我当前的机器配置和设计来说 ...
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ash_riple_768180695
2008-1-5 08:51
FSM的最佳描述——输出同步的Mealy型状态机
在 上一篇关于FSM的blog 中,我分析了状态机输出同步对状态机运行性能的影响——结论是,输出同步可以带来运行性能的提升。 riple ...
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2008-1-2 10:36
加快SignalTAP II编译过程的小技巧
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