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Viterbi De
c
oder Blo
c
k De
c
oding - Trellis Termination and Tail Biting
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大小：747.19KB
时间：2020.03.06
上传者：238112554_qq
ViterbiDe
c
oderBlo
c
kDe
c
oding-TrellisTerminationandTailBitingAppli
c
ationNote:AllVirtexandSpartanFPGAFa
Xilinx
fpga
A 3/4/5/6X Oversampling Cir
c
uit for 200 Mb/s to 1000 Mb/s Serial Interfa
c
es(
所需E币：5
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大小：678.73KB
时间：2020.03.06
上传者：quw431979_163.com
A3/4/5/6XOversamplingCir
c
uitfor200Mb/sto1000Mb/sSerialInterfa
c
es(Appli
c
ationNote:Virtex-IIProFamilyR
Xilinx
fpga
Forward Error Corre
c
tion on ITU-G.709 Networks using Reed-Solomon Solutions
所需E币：4
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大小：406.42KB
时间：2020.03.06
上传者：238112554_qq
ForwardErrorCorre
c
tiononITU-G.709NetworksusingReed-SolomonSolutionsAppli
c
ationNote:Virtex-4andVirtex
Xilinx
fpga
170 MHz FIFOs Using the Virtex Blo
c
k Sele
c
tRAM+ Feature - Obsolete
所需E币：4
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大小：83.53KB
时间：2020.03.06
上传者：16245458_qq.com
170MHzFIFOsUsingtheVirtexBlo
c
kSele
c
tRAM+Feature-ObsoleteAppli
c
ationNote:VirtexSeriesR170MHzFIFOsUsin
Xilinx
fpga
FIFOs Using Virtex-II Blo
c
k RAM - Obsolete
所需E币：5
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大小：66.45KB
时间：2020.03.06
上传者：rdg1993
FIFOsUsingVirtex-IIBlo
c
kRAM-ObsoleteProdu
c
tObsolete/UnderObsoles
c
en
c
eAppli
c
ationNote:Virtex-IISeries
Xilinx
fpga
Parameterizable Lo
c
alLink FIFO - Not Re
c
ommended for New Designs
所需E币：5
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大小：238.18KB
时间：2020.03.06
上传者：quw431979_163.com
ParameterizableLo
c
alLinkFIFO-NotRe
c
ommendedforNewDesignsAppli
c
ationNote:Virtex-IIandVirtex-IIProFami
Xilinx
fpga
Virtex 器件中的多个 CAM 设计概述
所需E币：5
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大小：47.29KB
时间：2020.03.06
上传者：二不过三
Virtex器件中的多个CAM设计概述APPLICATIONNOTE0RAnOverviewofMultipleCAMDesignsinVirtexFamilyDevi
c
esXAPP201,Septe
Xilinx
fpga
High-Performan
c
e DDR2 SDRAM Interfa
c
e in Virtex-5 Devi
c
es
所需E币：4
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大小：1.06MB
时间：2020.03.06
上传者：quw431979_163.com
High-Performan
c
eDDR2SDRAMInterfa
c
einVirtex-5Devi
c
esAppli
c
ationNote:Virtex-5FPGAsRHigh-Performan
c
eDDR
Xilinx
fpga
RLDRAM II Memory Interfa
c
e for Virtex-5 FPGAs
所需E币：4
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大小：517.4KB
时间：2020.03.06
上传者：2iot
RLDRAMIIMemoryInterfa
c
eforVirtex-5FPGAsAppli
c
ationNote:Virtex-5FPGAsRRLDRAMIIMemoryInterfa
c
eforVirte
Xilinx
fpga
参考系统：决定 DDR 反馈时钟的最佳 DCM 相移
所需E币：5
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大小：1.24MB
时间：2020.03.06
上传者：2iot
参考系统：决定DDR反馈时钟的最佳DCM相移Appli
c
ationNote:EmbeddedPro
c
essingRReferen
c
eSystem:DeterminingtheOptimalDCMPha
Xilinx
fpga
面向 Virtex-4 FPGA 的可综合 CIO DDR RLDRAM II 控制器
所需E币：5
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大小：308.65KB
时间：2020.03.06
上传者：rdg1993
面向Virtex-4FPGA的可综合CIODDRRLDRAMII控制器Appli
c
ationNote:Virtex-4FamilyRSynthesizableCIODDRRLDRAMIIControl
Xilinx
fpga
用 Xilinx CPLD 与 NAND Flash 存储器器件接口
所需E币：4
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大小：417.3KB
时间：2020.03.06
上传者：微风DS
用XilinxCPLD与NANDFlash存储器器件接口Appli
c
ationNote:CoolRunnerCPLDRUsingXilinxCPLDstoInterfa
c
etoaNANDFlashMe
Xilinx
fpga
一款小巧的36 - 72V DC输入， 3.3V/10A输出的电源
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大小：363.82KB
时间：2020.03.06
上传者：wsu_w_hotmail.com
摘要：紧凑型电源提供电流高达10A使用MAX5052APWM控制器稳压3.3V这里所描述的。此电源供电来源-36V至-72V，采用同步整流实现10A效率大于88％。它使用了一个单晶体管正激变换器的复位
maxim
max5052
pwm
转换过程中从闭锁模式打嗝模式短路的电路中的CPU核电源
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大小：64.46KB
时间：2020.03.06
上传者：238112554_qq
摘要：本设计笔记显示了如何从闭锁模式转换CPU核心供电，打嗝模式短路时。添加两个廉价的核心控制器的电压比较器，可以使打嗝模式输出短路后重新启动。特色MAX1937/MX1938/MAX1939CPU内
maxim
latch-off
latchoff
Charlieplexing-减针数 LED 显示屏多路复用
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大小：71KB
时间：2020.03.06
上传者：238112554_qq
摘要：此应用程序说明讨论"Charlieplexing"——针数减少多重使用的MAX6950、MAX6951、MAX6954、MAX6955、MAX6958和MAX6959LED显示驱动程序的技术。M
maxim
charlie
charlieplex
电流限制直流-直流控制器使用一样升压降压SEPIC电源的 USB 设备
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大小：35.3KB
时间：2020.03.06
上传者：givh79_163.com
摘要：USB供电设备需要受规管的供应。不幸的是，USB总线电压可以因4V9V。将MAX668升压控制器配置到步上/步落拓扑可以生成电流限制受规管的供应。Maxim>AppNotes>AUTOMOTIV
maxim
usb
universal
LCD显示超声测距、温度、ADC数据采集结果，带实时时钟
所需E币：5
下载：0
大小：19.34KB
时间：2020.03.06
上传者：wsu_w_hotmail.com
LCD显示超声测距、温度、ADC数据采集结果，带实时时钟……
lcd显示
超声测距
温度采集
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