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新增高电压能力的MAX471/MAX472高侧电流检测放大器
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时间:2020.03.06
上传者:238112554_qq
摘要:雪崩二极管和电流源提供一个浮动的电源,使高边电流检测放大器工作在高达300V。Maxim>AppNotes>AMPLIFIERANDCOMPARATORCIRCUITSAUTOMOTIVEKey
maxim
high
voltage
提高系统可靠性的看门狗 — — 如何选择正确的一部分
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大小:103.03KB
时间:2020.03.06
上传者:16245458_qq.com
摘要:看门狗定时器用于监视和尽量减少代码执行错误。内部看门狗定时器会遵守执行问题的代码,使外部看门狗电路宝贵在防止系统锁定。Maxim>AppNotes>AUTOMOTIVEMICROPROCESSO
maxim
watchdog
timer
伽玛光子辐射探测器
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时间:2020.03.06
上传者:978461154_qq
:PIN光电二极管,四个低噪声运算放大器和比较器,用于探测单个光子的伽玛射线。的原理,设计考虑和选择组件进行了讨论。Maxim/Dallas>AppNotes>AMPLIFIERANDCOMPARAT
maxim
gamma
ray
超低静态电流供应的125kHz ASK接收器
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时间:2020.03.06
上传者:rdg1993
摘要:本应用笔记显示了一个简单的设计为125kHz的要求轮胎压力监测系统(TPMS)的接收器。这LFRF接收器,只需要一个2.1V的电源电压和4μA(典型值)电源电流。本设计采用了一个小小的比较,作为
maxim
ask
receiver
高效的移位寄存器、LFSR 计数器和长伪随机序列发生器
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时间:2020.03.06
上传者:givh79_163.com
高效的移位寄存器、LFSR计数器和长伪随机序列发生器APPLICATIONNOTEEfcientShiftRegisters,LFSRCounters,andLongPseudo-RandomSequ
Xilinx
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将 DDR SDRAM 与 CoolRunner-II CPLD 接口
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时间:2020.03.06
上传者:2iot
将DDRSDRAM与CoolRunner-IICPLD接口ApplicationNote:CoolRunner-IICPLDsRInterfacingtoDDRSDRAMwithCoolRunner-
Xilinx
fpga
利用 CoolRunner-II CPLD 和 SPI 闪存配置 Xilinx FPGA
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时间:2020.03.06
上传者:rdg1993
利用CoolRunner-IICPLD和SPI闪存配置XilinxFPGA’ApplicationNote:CoolRunner-IICPLDRConfiguringXilinxFPGAswithSP
Xilinx
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使用 Virtex-5 FPGA 器件实现 DDR SDRAM 控制器(中文版)(
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时间:2020.03.06
上传者:wsu_w_hotmail.com
使用Virtex-5FPGA器件实现DDRSDRAM控制器(中文版)(应用指南:Virtex-5系列R使用Virtex-5FPGA器件实现DDRSDRAM控制器XAPP851(v1.1)2006年7月
Xilinx
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使用 ISERDES 和 OSERDES 实现高性能 DDR2 SDRAM 接口数据采集
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时间:2020.03.06
上传者:wsu_w_hotmail.com
使用ISERDES和OSERDES实现高性能DDR2SDRAM接口数据采集ApplicationNote:Virtex-4FPGAsRHigh-PerformanceDDR2SDRAMInterfac
Xilinx
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存储器接口应用指南概述
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时间:2020.03.06
上传者:238112554_qq
存储器接口应用指南概述ApplicationNote:VirtexSeriesandSpartan-3SeriesFPGAsRMemoryInterfaceApplicationNotesOvervi
Xilinx
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更宽的块存储器
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时间:2020.03.06
上传者:wsu_w_hotmail.com
更宽的块存储器ApplicationNote:Virtex-IIandSpartan-3SeriesRWiderBlockMemoriesAuthor:NickSawyer,MarcDefossezX
Xilinx
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用于 RAID6 奇偶生成/数据恢复控制器的硬件加速器
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时间:2020.03.06
上传者:wsu_w_hotmail.com
用于RAID6奇偶生成/数据恢复控制器的硬件加速器ApplicationNote:Virtex-5FamilyRHardwareAcceleratorforRAID6ParityGeneration/
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Using Digitally Controlled Impedance: Signal Integrity vs Power Dissipation Considerations
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时间:2020.03.06
上传者:rdg1993
UsingDigitallyControlledImpedance:SignalIntegrityvsPowerDissipationConsiderationsApplicationNote:Vir
Xilinx
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参考设计:带有 OPB 中心 DMA 的 MCH OPB EMC
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时间:2020.03.06
上传者:2iot
参考设计:带有OPB中心DMA的MCHOPBEMCApplicationNote:EmbeddedProcessingRReferenceSystem:MCHOPBEMCwithOPBCentralD
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Accelerating System Designs Requiring High-Bandwidth Connectivity with Targeted Reference Designs
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AcceleratingSystemDesignsRequiringHigh-BandwidthConnectivitywithTargetedReferenceDesignsWhitePaper:S
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High-Volume Spartan-6 FPGAs: Performance and Power Leadership by Design
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时间:2020.03.06
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High-VolumeSpartan-6FPGAs:PerformanceandPowerLeadershipbyDesignWhitePaper:Spartan-6FPGAsWP396(v1.0)M
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FIFOs Using Virtex-II Shift Registers - Obsolete
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时间:2020.03.06
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FIFOsUsingVirtex-IIShiftRegisters-ObsoleteProductObsolete/UnderObsolescenceApplicationNote:Virtex-II
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